參數(shù)資料
型號： KS8721SL-EVAL
廠商： Micrel Inc
文件頁數(shù)： 19/33頁
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描述： BOARD EVAL EXPERIMENT KS8721SL
標(biāo)準(zhǔn)包裝： 1
主要目的： 接口，以太網(wǎng)控制器（PHY 和 MAC）
嵌入式： 否
已用 IC / 零件： KSZ8721SL
主要屬性： 1 個端口，100BASE-TX/100BASE-FX/10BASE-T
次要屬性： MII，RMII，自動 MDI，MDIX，>130 米線纜驅(qū)動器，LDO，符合 IEEE802.3u 要求
已供物品： 板
相關(guān)產(chǎn)品： KS8721SLA4 TR-ND - TXRX 10/100 3.3V 48-SSOP
KS8721SLA4-ND - TXRX 10/100 3.3V 48-SSOP
KS8721SL-ND - TXRX 10/100 3.3V 48-SSOP
KS8721SLI-ND - IC TXRX PHY 10/100 3.3V 48SSOP
KS8721SL TR-ND - IC TXRX PHY 10/100 3.3V 48SSOP
其它名稱： 576-1010
KS8721BL/SL
Micrel
M9999-051704
26
May 2004
TXC
t
SU2
TXE N
t
HD2
TXD[3:0],
TXE R
t
SU1
CRS
t
CRS2
t
CRS1
TX+/TX-
t
LAT
t
HD1
Symbol
Out
Data
In
Figure 5. 100BASE-T MII Transmit Timing
Symbol
Parameter
Min
Typ
Max
Units
t
SU1
TXD [3:0] Set-Up to TXC High
10
ns
t
SU2
TXEN Set-Up to TXC High
10
ns
t
HD1
TXD [3:0] Hold After TXC High
0
ns
t
HD2
TXER Hold After TXC High
0
ns
t
HD3
TXEN Hold After TXC High
0
ns
t
CRS1
TXEN High to CRS Asserted Latency
4
BT
t
CRS2
TXEN Low to CRS De-Asserted Latency
4
BT
t
LAT
TXEN High to TX+/TX– Output (TX Latency)
7
BT
Table 4. 100BASE-T MII Transmit Timing Parameters
相關(guān)PDF資料
PDF描述
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RMM08DTKH CONN EDGECARD 16POS DIP .156 SLD
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相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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KS8803 制造商:SAMSUNG 制造商全稱:Samsung semiconductor 功能描述:10/15 CH PLL
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