參數(shù)資料
型號: ISPLSI5128VE-125LT128
廠商: LATTICE SEMICONDUCTOR CORP
元件分類: PLD
英文描述: In-System Programmable 3.3V SuperWIDE High Density PLD
中文描述: EE PLD, 7.5 ns, PQFP128
封裝: TQFP-128
文件頁數(shù): 11/21頁
文件大?。?/td> 211K
代理商: ISPLSI5128VE-125LT128
Specifications
ispLSI 5128VE
11
Switching Test Conditions
Input Pulse Levels
Input Rise and Fall Time
Table 2-0003/5KVE
Input Timing Reference Levels
Ouput Timing Reference Levels
Output Load
3-state levels are measured 0.5V from
steady-state active level.
GND to V
CCIOmin
1.5ns 10% to 90%
1.5V
1.5V
See Figure 9
Output Load Conditions (See Figure 9)
TEST CONDITION
A
Active High
Active Low
Active High to Z
at V -0.5V
R1
511
3.3V
2.5V
R2
475
475
CL
35pF
35pF
35pF
D
35pF
B
Slow Slew
C
5pF
5pF
511
511
475
R1
316
R2
348
348
316
316
348
Active Low to Z
at V +0.5V
Table 2-0004A/5KVE
DC Electrical Characteristics for 3.3V Range
1
Over Recommended Operating Conditions
Figure 9. Test Load
V
CCIO
R1
R2
CL
*
Device
Output
Test
Point
*
CL includes Test Fixture and Probe Capacitance.
0213D
V
OL
V
OH
SYMBOL
V
CCIO
1. I/O voltage configuration must be set to VCC.
Table 2-0007/5KVE
V
IH
V
IL
PARAMETER
Output Low Voltage
Output High Voltage
Input High Voltage
Input Low Voltage
V
CCIO = min
, I
OL
= 8 mA
V
CCIO = min
, I
OH
= -4 mA
CONDITION
MIN.
3.0
TYP.
MAX.
3.6
UNITS
V
V
2.4
2.0
-0.3
0.4
5.25
0.8
V
V
I/O Reference Voltage
V
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PDF描述
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