參數(shù)資料
型號(hào)： ISL5314EVAL2
廠商： Intersil Corporation
元件分類： XO, clock
英文描述： Direct Digital Synthesizer
中文描述： 直接數(shù)字頻率合成器
文件頁數(shù)： 13/16頁
文件大?。?/td> 809K
代理商： ISL5314EVAL2
13
FIGURE 7. SERIAL PROGRAMMING, SYNC EARLY MODE (REPRESENTS MINIMUM SCLKS REQUIRED. SCLK CAN FREE RUN.)
CONTROL REGISTER 12 IS SET TO 0001 00XX.
FIGURE 8. SERIAL PROGRAMMING, SYNC LATE BURST MODE (REPRESENTS MINIMUM SCLKS REQUIRED; SCLK CAN FREE RUN);
CONTROL REGISTER 12 IS SET TO 0000 00XX.
Timing Diagrams
(Continued)
SSYNC
SDATA
CLK (f
CLK
)
ANALOG OUT
t
= 12 f
CLK
RISING EDGES
OLD FREQ IN THE
SERIAL REGISTER
NEW FREQ LOADED
IN THE SERIAL REGISTER
SERIAL FREQ
REGISTER
SERIAL DATA (8 BITS SHOWN; MAX IS 40)
SCLK
SCLK EDGES = SERIAL BITS + 3
DON’T CARE (CAN FREE RUN)
DON’T CARE (ASSUMED CONTINUOUSLY RUNNING)
DON’T CARE
RESET
OLD FREQ
NEW FREQ
DON’T CARE
t
SDH
t
SDS
t
SSH
t
SSS
t
SCW
t
SSW
t
SDW
SSYNC
SDATA
CLK (f
CLK
)
ANALOG OUT
t
= 12 f
CLK
RISING EDGES
OLD FREQ IN THE
SERIAL REGISTER
NEW FREQ LOADED
IN THE SERIAL REGISTER
SERIAL FREQ
REGISTER
SERIAL DATA (8 BITS SHOWN; MAX IS 40)
SCLK
SCLK EDGES = SERIAL BITS + 3
DON’T CARE (CAN FREE RUN)
DON’T CARE (ASSUMED CONTINUOUSLY RUNNING)
DON’T CARE
RESET
OLD FREQ
NEW FREQ
DON’T CARE
ISL5314
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PDF描述
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