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參數(shù)資料
| 型號： | ISAC-SXPEB3086 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | ISDN SUBSCRIBER ACCESS CONTROLLER |
| 中文描述： | ISDN用戶接入控制器 |
| 文件頁數(shù)： | 185/262頁 |
| 文件大?。?/td> | 3476K |
| 代理商： | ISAC-SXPEB3086 |
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ISAC-SX
PEB 3086
Detailed Register Description
Data Sheet
185
2003-01-30
LP_A ... Loop Analog
The setting of this bit corresponds to the C/I command ARL.
0: Analog loop is open
1: Analog loop is closed internally or externally according to the EXLP bit in the
TR_CONF0 register
For general information please refer to
Chapter 3.3.11
.
4.2.6
Value after reset: 40
H
SQRR1 - S/Q-Channel Receive Register 1
For general information please refer to
Chapter 3.3.2
.
MSYN ... Multi-frame Synchronization State
0: The S/T receiver has not synchronized to the received F
A
and M bits
1: The S/T receiver has synchronized to the received F
A
and M bits
MFEN ... Multiframe Enable
Read-back of the MFEN bit of the SQXR register
SQR11-14 ... Received S Bits
Received S bits in frames 1, 6, 11 and 16 (TE mode)
received Q bits in frames 1, 6, 11 and 16 (NT mode).
7
0
SQRR
MSYN MFEN
0
0
SQR1 SQR2 SQR3 SQR4
RD (35)
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