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參數(shù)資料
| 型號： | IDTCSPT857DNLG8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 3/15頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PLL CLK DVR SDRAM 40-VFQFPN |
| 產品變化通告： | Product Discontinuation 09/Dec/2011 |
| 標準包裝： | 5,000 |
| 類型： | 時鐘緩沖器/驅動器，零延遲緩沖器，多路復用器 |
| PLL： | 是 |
| 主要目的： | 存儲器，DDR，SDRAM |
| 輸入： | 時鐘 |
| 輸出： | 時鐘 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:10 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 220MHz |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 40-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 40-VFQFPN（6x6） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | CSPT857DNLG8 |
11
IDTCSPT857D
2.5V - 2.6V PLL DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER
COMMERCIALTEMPERATURERANGE
Yx, FBOUT
tjit(cc)
tcycle n
tcycle n+1
=
Yx, FBOUT
tcycle n
tcycle n+1
FBIN
CLK
t()n
t()n + 1
t() =
N
n = N
1
t()n
∑
CLK
FBIN
(N is a large number of samples)
Figure 3. Cycle-to-Cycle jitter
Figure 4. Static Phase Offset
Yx, FBOUT
Yx
tsk(o)
Yx, FBOUT
Yx
Figure 5. Output Skew
TEST CIRCUIT AND SWITCHING WAVEFORMS
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| IDTCSPT857DPAGI | 功能描述:IC PLL CLK DVR SDRAM 48-TSSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標準包裝:1,500 系列:- 類型:時鐘緩沖器/驅動器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應商設備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱:93786AFT |
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