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參數(shù)資料
| 型號： | IDT82V2616BB |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 5/99頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC INVERSE MUX 16CH ATM 272-PBGA |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 應(yīng)用： | 無線 |
| 接口： | Utopia |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 封裝/外殼： | 260-BGA |
| 供應(yīng)商設(shè)備封裝： | 260-PBGA（19x19） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
| 其它名稱： | 82V2616BB |
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PIN DESCRIPTION
13
December 4, 2006
IDT82V2616
Inverse Multiplexing for ATM
RxAddr4
RxAddr3
RxAddr2
RxAddr1
RxAddr0
C18
D16
D17
D18
E15
I
RxAddr[4:0]: Utopia Receive Address
Utopia receive port address driven from the ATM layer to poll and select an appropriate port.
The RxAddr[4:0] input bus are sampled on the rising edge of RxClk.
RxData7
RxData6
RxData5
RxData4
RxData3
RxData2
RxData1
RxData0
B16
A16
C15
B15
A15
D14
C14
B14
High-Z
O
RxData[7:0]: Utopia Receive Data
Utopia 8-bit data bus driven from the IDT82V2616 to the ATM layer.
The RxData[7:0] output bus are updated on the rising edge of RxClk.
RxClav
C17
High-Z
O
RxClav: Utopia Receive Cell Available
Utopia cell available signal. A polled port drives RxClav only during each cycle following one with its
address on the RxAddr lines. The polled port asserts RxClav high to indicate its corresponding FIFO
has a complete cell available for transfer to the ATM layer, otherwise it deasserts the signal.
The RxClav output is updated on the rising edge of RxClk.
Note: This pin requires a pull-down resistor.
RxSOC
C16
High-Z
O
RxSOC: Utopia Receive Start of Cell
Utopia start of cell pulse. It will be driven high when RxData[7:0] contain the first valid byte of a cell.
The RxSOC input is updated on the rising edge of RxClk.
T1/E1 Line Interface
TSD16
TSD15
TSD14
TSD13
TSD12
TSD11
TSD10
TSD9
TSD8
TSD7
TSD6
TSD5
TSD4
TSD3
TSD2
TSD1
U3
T4
R5
V5
U6
T7
R8
V8
U9
U10
V11
R11
T12
U13
V14
R14
O
TSDn: Transmit Side Data Output
TSDn contains the transmit data for the n-th link.
The TSDn output is updated on the rising edge of TSCKn or TSCCK if common clock is used.
Table-1 Pin Description (Continued)
Name
Pin Number
Input/Output
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VI-JT1-IW-F1 | CONVERTER MOD DC/DC 12V 100W |
| IDT82V2608BB | IC INVERSE MUX 8CH ATM 208-BGA |
| PIC24FV16KA302-I/SO | MCU 16KB FLASH 2KB RAM 28-SOIC |
| PIC16C716-20/SO | IC MCU OTP 2KX14 A/D PWM 18SOIC |
| IDT82V2604BB | IC INVERSE MUX 4CH ATM 208-BGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IDT82V2616BBG | 功能描述:IC INVERSE MUX 16CH ATM 272-PBGA RoHS:是 類別:集成電路 (IC) >> 接口 - 專用 系列:- 標(biāo)準(zhǔn)包裝:3,000 系列:- 應(yīng)用:PDA，便攜式音頻/視頻，智能電話 接口:I²C，2 線串口 電源電壓:1.65 V ~ 3.6 V 封裝/外殼:24-WQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:24-QFN 裸露焊盤（4x4） 包裝:帶卷 (TR) 安裝類型:表面貼裝 產(chǎn)品目錄頁面:1015 (CN2011-ZH PDF) 其它名稱:296-25223-2 |
| IDT82V3001A | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:WAN PLL WITH SINGLE REFERENCE INPUT |
| IDT82V3001A_08 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:WAN PLL WITH SINGLE REFERENCE INPUT |
| IDT82V3001APV | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:WAN PLL WITH SINGLE REFERENCE INPUT |
| IDT82V3001APVG | 功能描述:IC PLL WAN W/SGL REF INP 56SSOP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 類型:時(shí)鐘/頻率發(fā)生器，多路復(fù)用器 PLL:是 主要目的:存儲器，RDRAM 輸入:晶體 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:1:2 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:Digi-Reel® 其它名稱:296-6719-6 |
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