OPERATING CHARACTERISTICS, T
參數資料
型號： IDT74SSTUA32866BFG8
廠商： IDT, Integrated Device Technology Inc
文件頁數： 3/19頁
文件大?。?/td> 0K
描述： IC BUFFER 1.8V CONFIG 96-BGA
標準包裝： 3,000
邏輯類型： 1:2 可配置寄存緩沖器
電源電壓： 1.7 V ~ 1.9 V
位數： 25，14
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 96-LFBGA
供應商設備封裝： 96-CABGA（13.5x5.5）
包裝： 帶卷 (TR)
其它名稱： 74SSTUA32866BFG8
11
COMMERCIALTEMPERATURERANGE
IDT74SSTUA32866
1.8VCONFIGURABLEREGISTEREDBUFFERWITHADDRESS-PARITYTEST
OPERATING CHARACTERISTICS, TA = 25C (1,2)
Symbol
Parameter
Min.
Typ.
Max.
Unit
VDD
SupplyVoltage
1.7
—
1.9
V
VREF
ReferenceVoltage
0.49 * VDD
0.5 * VDD
0.51 * VDD
V
VTT
TerminationVoltage
VREF– 40mV
VREF
VREF+ 40mV
V
VI
InputVoltage
0
—
VDD
V
VIH
AC High-Level Input Voltage
VREF+ 250mV
—
VIL
AC Low-Level Input Voltage
Data Inputs, CSR, DCS,—
—
VREF– 250mV
V
VIH
DC High-Level Input Voltage
PAR_IN
VREF+ 125mV
—
VIL
DC Low-Level Input Voltage
—
VREF– 125mV
VIH
High-LevelInputVoltage
RESET, Cx
0.65 * VDD
——
V
VIL
Low-LevelInputVoltage
RESET, Cx
—
0.35 * VDD
V
VICR
CommonModeInputVoltage
CLK, CLK
0.675
—
1.125
V
VID
DifferentialInputVoltage
CLK, CLK
600
—
mV
IOH
High-LevelOutputCurrent
Data Outputs, PPO
—
–8
mA
IOL
Low-LevelOutputCurrent
Data Outputs, PPO, QERR
——
8
TA
OperatingFree-AirTemperature
0
—
70
°C
NOTES:
1. The RESET and Cx inputs of the device must be held at valid levels (not floating) to ensure proper device operation.
2. The differential inputs must not be floating unless RESET is LOW.
Symbol
Parameter
Test Conditions
Min.
Typ.
Max.
Unit
VOH
Output HIGH Voltage
IOH = –6 mA
1.2
—
V
VOL
OutputLOWVoltage
IOL = 6 mA
—
0.5
V
II
All Inputs(1)
VI = VDD or GND; VDD = 1.9V
—
±5
μA
IDD
StaticStandby
IO = 0, VDD = 1.9V, RESET = GND
—
100
μA
StaticOperating
IO = 0, VDD = 1.9V, RESET = VDD, VI = VIH (AC) or VIL (AC)
——
40
mA
IDDD
DynamicOperating
IO = 0, VDD = 1.8V, RESET = VDD, VI = VIH (AC) or VIL (AC),—
—
μA/Clock
(Clock Only)
CLK and CLK Switching 50% Duty Cycle.
MHz
IO = 0, VDD = 1.8V, RESET = VDD,
1:1 Mode
—
DynamicOperating
VI = VIH (AC) or VIL (AC), CLK and CLK Switching at
μA/Clock
(PerEachDataInput)
50% Duty Cycle. One Data Input Switching at
1:2 Mode
—
MHz/Data
Half Clock Frequency, 50% Duty Cycle.
Input
Data Inputs, CSR, PAR_IN
2.5
—
3.5
CI
CLK and CLK
VICR = 0.9V, VID = 600mV
2
—
3
pF
RESET
VI = VDD or GND
—
DC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE
FollowingConditionsApplyUnlessOtherwiseSpecified:
Operating Condition: TA = 0°C to +70°C, VDD = 1.8V ± 0.1V
NOTE:
1. Each VREF pin (A3, T3) should be tested independently, with the other pin open circuit.
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PDF描述
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