VCC Pulse D " />
參數(shù)資料
型號: IDT74ALVCH32244BFG
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 6/7頁
文件大?。?/td> 0K
描述: IC BUFF DVR TRI-ST 32BIT 96LFBGA
標(biāo)準(zhǔn)包裝: 270
系列: 74ALVCH
邏輯類型: 緩沖器/線路驅(qū)動器,非反相
元件數(shù): 8
每個元件的位元數(shù): 4
輸出電流高,低: 24mA,24mA
電源電壓: 2.3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 96-LFBGA
供應(yīng)商設(shè)備封裝: 96-CABGA(13.5x5.5)
包裝: 管件
產(chǎn)品目錄頁面: 1257 (CN2011-ZH PDF)
其它名稱: 74ALVCH32244BFG
800-1557
INDUSTRIALTEMPERATURERANGE
6
IDT74ALVCH32244
3.3VCMOS32-BITBUFFER/DRIVERWITH3-STATEOUTPUTS
VCC
Pulse
D U T
VIN
VOU
(1, 2)
TEST CIRCUITS AND WAVEFORMS
Propagation Delay
Test Circuit for All Outputs
Enable and Disable Times
Set-up, Hold, and Release Times
NOTES:
1.
For tSK(o) OUTPUT1 and OUTPUT2 are any two outputs.
2.
For tSK(b) OUTPUT1 and OUTPUT2 are in the same bank.
DEFINITIONS:
CL = Load capacitance: includes jig and probe capacitance.
RT = Termination resistance: should be equal to ZOUT of the Pulse Generator.
NOTES:
1. Pulse Generator for All Pulses: Rate
≤ 1.0MHz; tF ≤ 2.5ns; tR ≤ 2.5ns.
2. Pulse Generator for All Pulses: Rate
≤ 1.0MHz; tF ≤ 2ns; tR ≤ 2ns.
Output Skew - tSK(X)
Pulse Width
NOTE:
1. Diagram shown for input Control Enable-LOW and input Control Disable-HIGH.
Symbol
VCC
(1)= 3.3V±0.3V VCC(1)=2.7V
VCC
(2)= 2.5V±0.2V
Unit
VLOAD
6
2 x Vcc
V
VIH
2.7
Vcc
V
VT
1.5
Vcc / 2
V
VLZ
300
150
mV
VHZ
300
150
mV
CL
50
30
pF
TEST CONDITIONS
SWITCH POSITION
Test
Switch
Open Drain
Disable Low
VLOAD
Enable Low
Disable High
GND
Enable High
All Other Tests
Open
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PDF描述
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參數(shù)描述
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