參數(shù)資料
型號(hào)： IDT72V8981J
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 6/9頁(yè)
文件大小： 0K
描述： IC DGTL SW 128X128 44-PLCC
標(biāo)準(zhǔn)包裝： 27
系列： 72V
類型： 多路復(fù)用器
電路： 1 x 4:4
獨(dú)立電路： 1
電壓電源： 單電源
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 44-PLCC（16.59x16.59）
包裝： 管件
其它名稱： 72V8981J
2010 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FAB1200 Rev 1.2.7
6
FAB
12
00
—
Ground
-Re
ferenc
ed
Class
-G
He
adp
hone
Ampli
fi
er
wi
th
I
n
tegrated
Buck
Co
nvert
er
I
2C DC Characteristics
Unless otherwise noted, AVDD = 2.5 V to 5.5 V and TA = 25°C.
Symbol
Parameter
Conditions
Fast Mode (400kHz)
Min.
Max.
Unit
VIL
Low-Level Input Voltage
AVDD 2.9 to 4.5 V
-0.3
0.6
V
VIH
High-Level Input Voltage
AVDD 2.9 to 4.5 V
1.2
V
VOL
Low-Level Output Voltage
at 3mA Sink Current
(Open-Drain or Open-Collector)
0
0.4
V
IIH
High-Level Input Current of Each I/O Pin
Input Voltage = A VDD
-1
1
A
IIL
Low-Level Input Current of Each I/O Pin
Input Voltage = 0 V
-1
1
A
I
2C AC Electrical Characteristics
Unless otherwise noted, AVDD = 2.5 V to 5.5 V and TA = 25°C.
Symbol
Parameter
Fast Mode
Min.
Max.
Unit
fSCL
SCL Clock Frequency
0
400
kHz
tHD;STA
Hold Time (Repeated) START Condition
0.6
s
tLOW
LOW Period of SCL Clock
1.3
s
tHIGH
HIGH Period of SCL Clock
0.6
s
tSU;STA
Set-up Time for Repeated START Condition
0.6
s
tHD;DAT
Data Hold Time
0
0.9
s
tSU;DAT
Data Set-up Time
100
ns
tr
Rise Time of SDA and SCL Signals
20+0.1Cb
300
ns
tf
Fall Time of SDA and SCL Signals
20+0.1Cb
300
ns
tSU;STO
Set-up Time for STOP Condition
0.6
s
tBUF
Bus Free Time between STOP and START Conditions
1.3
s
tSP
Pulse Width of Spikes that Must Be Suppressed by the Input Filter
0
50
ns
Notes:
2.
A fast-mode I
2C-Bus device can be used in a standard-mode I2C-bus system, but the requirement t
SU;DAT
≥
250ns LOW period of the SCL signal. If such a device does stretch the LOW period of the SCL signal, it must
output the next data bit to the SDA line tr_max + tSU;DAT = 1000 + 250 = 1250 ns (according to the standard-mode
I
2C bus specification) before the SCL line is released.
3.
Cb equals the total capacitance of one bus line in pf. If mixed with high-speed mode devices, faster fall times are
allowed according to the I
2C specification.
Figure 3. Definition of Timing for Full-Speed Mode Devices on the I
2C Bus
All marks are the property of their respective owners.
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PDF描述
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參數(shù)描述
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IDT72V8981JG 功能描述:IC DGTL SW 128X128 44-PLCC RoHS:是 類別:集成電路 (IC) >> 邏輯 - 信號(hào)開關(guān)，多路復(fù)用器，解碼器 系列:72V 標(biāo)準(zhǔn)包裝:48 系列:74VHC 類型:多路復(fù)用器 電路:4 x 2:1 獨(dú)立電路:1 輸出電流高，低:8mA，8mA 電壓電源:單電源 電源電壓:2 V ~ 5.5 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.154"，3.90mm 寬） 供應(yīng)商設(shè)備封裝:16-SOIC 包裝:管件
IDT72V8981JG8 功能描述:IC DGTL SW 128X128 44-PLCC RoHS:是 類別:集成電路 (IC) >> 邏輯 - 信號(hào)開關(guān)，多路復(fù)用器，解碼器 系列:72V 標(biāo)準(zhǔn)包裝:48 系列:74VHC 類型:多路復(fù)用器 電路:4 x 2:1 獨(dú)立電路:1 輸出電流高，低:8mA，8mA 電壓電源:單電源 電源電壓:2 V ~ 5.5 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.154"，3.90mm 寬） 供應(yīng)商設(shè)備封裝:16-SOIC 包裝:管件
IDT72V8985J 功能描述:IC DGTL SW 256X256 44-PLCC RoHS:否 類別:集成電路 (IC) >> 邏輯 - 信號(hào)開關(guān)，多路復(fù)用器，解碼器 系列:72V 標(biāo)準(zhǔn)包裝:48 系列:74VHC 類型:多路復(fù)用器 電路:4 x 2:1 獨(dú)立電路:1 輸出電流高，低:8mA，8mA 電壓電源:單電源 電源電壓:2 V ~ 5.5 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.154"，3.90mm 寬） 供應(yīng)商設(shè)備封裝:16-SOIC 包裝:管件
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