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參數(shù)資料
| 型號(hào)： | IDT72V84L15PAG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 9/12頁 |
| 文件大小： | 0K |
| 描述： | IC FIFO ASYNCH 2048X18 56TSSOP |
| 標(biāo)準(zhǔn)包裝： | 34 |
| 系列： | 72V |
| 功能： | 異步 |
| 存儲(chǔ)容量： | 36.8K（2K x 18） |
| 數(shù)據(jù)速率： | 40MHz |
| 訪問時(shí)間： | 15ns |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 56-TFSOP（0.240"，6.10mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 56-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | 72V84L15PAG |
6
COMMERCIAL ANDINDUSTRIAL
TEMPERATURERANGES
IDT72V81/72V82/72V83/72V84/72V85 3.3V CMOS DUAL ASYNCHRONOUS FIFO
512 x 9, 1024 x 9, 2048 x 9, 4096 x 9, 8192 x 9
Figure 5. Empty Flag From Last Read to First Write
Figure 8. Minimum Timing for an Full Flag Coincident Write Pulse
Figure 7. Minimum Timing for an Empty Flag Coincident Read Pulse
Figure 6. Retransmit
FF
R
W
tRFF
tWPF
3966 drw 10
EF
W
R
tWEF
tRPE
3966 drw 09
tRTC
tRT
tRTS
RT
W,R
HF, EF, FF
tRTR
FLAG VALID
tRTF
3966 drw 08
LAST READ
R
IGNORED
READ
FIRST WRITE
ADDITIONAL
WRITES
W
EF
tWEF
VALID
tA
DATA OUT
tREF
3966 drw 07
FIRST READ
VALID
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| IDT72V84L15PA | IC FIFO ASYNCH 2048X18 56TSSOP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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