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參數(shù)資料
| 型號： | IDT72V2113L7-5BCI |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 3/46頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FIFO SYNC 3.3V 5NS 100-LBGA |
| 標準包裝： | 1 |
| 系列： | 72V |
| 功能： | 同步 |
| 存儲容量： | 4.7Mb（262k x 18） |
| 訪問時間： | 5ns |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LBGA |
| 供應商設備封裝： | 100-CABGA（11x11） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 1255 (CN2011-ZH PDF) |
| 其它名稱： | 72V2113L7-5BCI 800-1513 |
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11
IDT72V263/273/283/293/103/113 3.3V HIGH DENSITY SUPERSYNC IITM NARROW BUS FIFO
8K x 18, 16K x 9/18, 32K x 9/18, 64K x 9/18, 128K x 9/18, 256K x 9/18, 512K x9
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72V2103/72V2113 3.3V HIGH DENSITY SUPERSYNC IITM NARROW BUS FIFO
131,072 x 18/262,144 x 9, 262,144 x 18/524,288 x 9
JUNE 1, 2010
Input Pulse Levels
GND to 3.0V
Input Rise/Fall Times
3ns(1)
Input Timing Reference Levels
1.5V
Output Reference Levels
1.5V
Output Load for tCLK = 10ns, 15 ns
See Figure 2a
Output Load for tCLK = 6ns, 7.5ns
See Figure 2b & 2c
AC TEST CONDITIONS
Figure 2b. AC Test Load
6119 drw04a
50
Ω
1.5V
I/O
Z0 = 50
Ω
6119 drw04b
6
5
4
3
2
1
20 30 50
80 100
200
Capacitance (pF)
tCD
(Typical,
ns)
Figure 2c. Lumped Capacitive Load, Typical Derating
ACTESTLOADS-6ns,7.5nsSpeedGrades
6119 drw04
330
Ω
30pF*
510
Ω
3.3V
D.U.T.
Figure 2a. Output Load
* Includes jig and scope capacitances.
NOTE:
1. For 166MHz and 133MHz operation input rise/fall times are 1.5ns.
AC TEST LOADS - 10ns, 15ns Speed Grades
VIH
OE
VIL
tOE & tOLZ
VCC
2
VCC
2
100mV
tOHZ
100mV
Output
Normally
LOW
Output
Normally
HIGH
VOL
VOH
VCC
2
VCC
2
6119 drw04c
Output
Enable
Output
Disable
OUTPUT ENABLE & DISABLE TIMING
NOTE:
1.
REN is HIGH.
相關(guān)PDF資料 |
PDF描述 |
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