SUPERSYNC FIFOTM
參數(shù)資料
型號(hào): IDT72V2105L15PF8
廠商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 14/26頁(yè)
文件大小: 0K
描述: IC FIFO SUPERSYNCII 15NS 64-TQFP
標(biāo)準(zhǔn)包裝: 750
系列: 72V
功能: 同步
存儲(chǔ)容量: 4.7Mb(262k x 18)
訪問(wèn)時(shí)間: 15ns
電源電壓: 3 V ~ 3.6 V
工作溫度: 0°C ~ 70°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 64-LQFP
供應(yīng)商設(shè)備封裝: 64-TQFP(14x14)
包裝: 帶卷 (TR)
其它名稱(chēng): 72V2105L15PF8
21
COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES
IDT72V295/72V2105 3.3V HIGH DENSITY CMOS
SUPERSYNC FIFOTM 131,072 x 18, 262,144 x 18
NOTES:
1. Retransmit setup is complete after
OR returns LOW.
2. No more than D - 2 words may be written to the FIFO between Reset (Master or Partial) and Retransmit setup. Therefore,
IR will be LOW throughout the Retransmit setup
procedure. D = 131,073 for the IDT72V295 and 262,145 for the IDT72V2105.
3.
OE = LOW
4. W1, W2, W3 = first, second and third words written to the FIFO after Master Reset.
5. There must be at least two words written to the FIFO before a Retransmit operation can be invoked.
Figure 12. Retransmit Timing (FWFT Mode)
Figure 13. Serial Loading of Programmable Flag Registers (IDT Standard and FWFT Modes)
NOTE:
1. X = 16 for the IDT72V295 and X = 17 for the IDT72V2105.
tREF
tRTS
tENH
4668 drw 15
tENS
Wx
WCLK
RCLK
REN
RT
OR
PAF
HF
PAE
Q0 - Qn
tSKEW2
12
1
tPAF
tHF
tPAE
tREF
Wx+1
2
W2
(4)
tENH
tRTS
WEN
tENS
W1
(4)
tENS
3
4
tENH
W3
(4)
tA
W4
tA
WCLK
SEN
SI
4668 drw 16
tENH
tENS
tLDS
LD
tDS
BIT 0
EMPTY OFFSET
BIT X
(1)
BIT 0
FULL OFFSET
tENH
BIT X
(1)
tLDH
tDH
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PDF描述
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IDT72V2113L15PF8 IC FIFO SUPERSYNCII 15NS 80-TQFP
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參數(shù)描述
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IDT72V2105L15PFI8 功能描述:IC FIFO SUPERSYNCII 15NS 64-TQFP RoHS:否 類(lèi)別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲(chǔ)容量:256(64 x 4) 數(shù)據(jù)速率:- 訪問(wèn)時(shí)間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類(lèi)型:通孔 封裝/外殼:24-DIP(0.300",7.62mm) 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱(chēng):74F433
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