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參數(shù)資料
| 型號： | IDT5T9304PGI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 5T SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO24 |
| 封裝： | TSSOP-24 |
| 文件頁數(shù)： | 15/15頁 |
| 文件大?。?/td> | 666K |
| 代理商： | IDT5T9304PGI |
IDT5T9304
2.5V LVDS 1:4 CLOCK BUFFER TERABUFFER II
PRELIMINARY
IIDT LVDS CLOCK BUFFER TERABUFFER II
9
IDT5T9304 REV. A JULY 23, 2007
Table 5E. AC Characteristics(1,5), TA = -40°C to 85°C
NOTE 1. AC propagation measurements should not be taken within the first 100 cycles of startup.
NOTE 2. Skew measured between crosspoints of all differential output pairs under identical input and output interfaces, transitions and
load conditions on any one device.
NOTE 3. Skew measured is the difference between propagation delay times tpHL and tpLH of any differential output pair under identical
input and output interfaces, transitions and load conditions on any one device.
NOTE 4. Skew measured is the magnitude of the difference in propagation times between any single differential output pair of two
devices, given identical transitions and load conditions at identical VDD levels and temperature.
NOTE 5. All parameters are tested with a 50% input duty cycle.
NOTE 6. Guaranteed by design but not production tested.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
tsk(o)
Same Device Output Pin-to-Pin Skew (2)
25
ps
tsk(p)
Pulse Skew(3)
250
ps
tsk(pp)
Part-to-Part Skew(4)
TBD
ps
tpLH
Propagation Delay, Low-to-High
A Crosspoint to Qn/Qn
Crosspoint
1.7
ns
tpHL
Propagation Delay, High-to-Low
1.4
ns
fo
Frequency Range(6)
450
MHz
tPGE
Output Gate Enable Crossing
VTHI-to-Qn/Qn Crosspoint
3.5
ns
tPGD
Output Gate Enable Crossing
VTHI-to-Qn/Qn Crosspoint Driven to
Designated Level
3.5
ns
tPWRDN
PD Crossing VTHI-to-Qn = VDD, Qn = VDD
100
S
tPWRUP
Output Gate Disable Crossing VTHI to
Qn/Qn Driven to Designated Level
100
S
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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