參數(shù)資料
型號： ICS9169F-01LF
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘產(chǎn)生/分配
英文描述： 66 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO28
封裝： 0.209 INCH, SSOP-28
文件頁數(shù)： 8/10頁
文件大?。?/td> 177K
代理商： ICS9169F-01LF
7
ICS9169-01
AC Characteristics
PARAMETER
SYMBOL
TEST CONDITIONS
MIN
TYP
MAX
UNITS
Rise Time1
Tr1
20pF load, 0.8 to 2.0V
PCLK & BCLK
-0.55
0.95
ns
Fall Time1
Tf1
20pF load, 2.0 to 0.8V
PCLK & BCLK
-0.52
0.90
ns
Rise Time1
Tr2
20pF load, 20% to 80%
PCLK & BCLK
-1.2
2.1
ns
Fall Time1
Tf2
20pF load, 80% to 20%
PCLK & BCLK
-1.1
2.0
ns
Duty Cycle1
Dt1
20pF load @ VOUT = 50% of VDD
45
50
55
%
Duty Cycle1
Dt2
20pF load @ VOUT = 1.4 V
50
55
60
%
Jitter, One Sigma1
Tj1s1
PCLK & BCLK Clocks; Load=20pF;
R=33
FOUT > 25 MHz
-
50
150
ps
Jitter, Absolute1
Tjab1
PCLK & BCLK Clocks; Load=20pF;
R=33
FOUT > 25 MHz
-250
-
250
ps
Jitter, One Sigma1
Tjis2
Fixed CLK; Load=20pF
R=33
-1
3
%
Jitter, Absolute1
Tjab2
Fixed CLK; Load=20pF
R=33
-5
2
5
%
Input Frequency1
Fi
12.0
14.318
16.0
MHz
Logic Input Capacitance1
CIN
Logic input pins
-
5
-
pF
Crystal Oscillator
Capacitance1
CINX
X1, X2 pins
-
18
-
pF
Power-on Time1
ton
From V=1.6V to 1st crossing of 66.5
MHz VDD supply ramp < 40 ms
-2.5
4.5
ms
Frequency Settling Time1
ts
From 1st crossing of acquisition to
< 1% settling
-2.0
4.0
ms
Clock Skew Window1
Tsk1
PCLK to PCLK;
Load=20pF; @1.4V
-
150
250
ps
Clock Skew Window1
Tsk2
BCLK to BCLK;
Load=20pF; @1.4V
-
300
500
ps
Clock Skew Window1
Tsk3
PCLK to BCLK;
Load=20pF; @1.4V
12.6
5
ns
Electrical Characteristics at 5.0 V
VDD = 4.5 - 5.5 V, TA = 0 - 70
oC unless otherwise stated
Note 1: Parameter is guaranteed by design and characterization. Not 100% tested in production.
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PDF描述
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參數(shù)描述
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