參數(shù)資料
型號： ICS894D115BGI-01LF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 15/16頁
文件大?。?/td> 0K
描述： IC CLK/DATA RECOVERY 20-TSSOP
標準包裝： 74
系列： HiPerClockS™
類型： 時鐘和數(shù)據(jù)恢復（CDR），多路復用器
PLL： 是
主要目的： STM-1，STM-4
輸入： LVPECL
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 622.08MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-TSSOP（0.173"，4.40mm 寬）
供應商設備封裝： 20-TSSOP
包裝： 管件
其它名稱： 894D115BGI-01LF
ICS894D115I-01
OC-12/STM-4 AND OC-3/STM-1 CLOCK/DATA RECOVERY DEVICE
IDT / ICS CLOCK/DATA RECOVERY DEVICE
8
ICS894D115BGI-01 REV. C OCTOBER 15, 2008
Parameter Measurement Information
3.3V Output Load AC Test Circuit
Output Duty Cycle/Pulse Width/Period
Jitter Tolerance Specification
Setup/Hold Time
Differential Input Level
SCOPE
Qx
nQx
LVPECL
V
EE
VCC
2V
.2V
-1.3V±0.165V
VCCA
nCLK_OUT,
t
PW
t
PERIOD
t
PW
t
PERIOD
odc =
x 100%
nDATA_OUT
CLK_OUT,
DATA_OUT
Requirement Mask
Input
Jitter
Amplitude
(UI
pp
)
Jitter Frequency (Hz)
slope = -20dB/decade
15
1.5
0.15
10
30
300
25k
250k
5M
t
H
t
SU
The re-timed data output (DATA_OUT) can be captured with the
rising edge of the clock output signal (CLOCK_OUT).
DATA_OUT is valid the specified setup time before the rising
CLK_OUT signal and remains valid the specified hold time after
the rising edge of the CLK_OUT signal.
nDATA_OUT
DATA_OUT
CLK_OUT
nCLK_OUT
V
IH
Cross Points
V
PP
V
IN = DATA_IN - nDATA_IN
VCC
nDATA_IN
DATA_IN
VEE
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PDF描述
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