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參數資料
| 型號： | ICS87973DYI-147LF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 2/19頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK MULT/ZD BUFFER 52TQFP |
| 標準包裝： | 160 |
| 系列： | HiPerClockS™ |
| 類型： | * |
| PLL： | 帶旁路 |
| 輸入： | HCSL，LVCMOS，LVDS，LVHSTL，LVPECL，LVTTL，SSTL |
| 輸出： | LVCMOS，LVTTL |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 3:12 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 150MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 52-LQFP |
| 供應商設備封裝： | 52-TQFP（10x10） |
| 包裝： | 托盤 |
ICS87973I-147
LOW SKEW, 1-TO-12, LVCMOS/LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER
IDT / ICS LVCMOS CLOCK MULTIPLIER/ZERO DELAY BUFFER
10
ICS87973DYI-147 REV. A DECEMBER 9, 2008
Parameter Measurement Information, continued
Output Duty Cycle/Pulse Width Period
Output Rise/Fall Time
Application Information
Recommendations for Unused Input and Output Pins
Inputs:
CLK/nCLK Inputs
For applications not requiring the use of the differential input, both
CLK and nCLK can be left floating. Though not required, but for
additional protection, a 1k
resistor can be tied from CLK to
ground.
CLK Inputs
For applications not requiring the use of the clock input, it can be
left floating. Though not required, but for additional protection, a
1k
resistor can be tied from the CLK to ground.
LVCMOS Control Pins
All control pins have internal pull-ups; additional resistance is not
required but can be added for additional protection. A 1k
resistor
can be used.
Outputs:
LVCMOS Outputs
All unused LVCMOS output can be left floating. There should be no
trace attached.
t
PERIOD
t
PW
t
PERIOD
odc =
V
DDO
2
x 100%
t
PW
QA[0:3],
QB[0:3],
QC[0:3],
QSYNC,
QFB
0.8V
2V
0.8V
tR
t F
QA[0:3],
QB[0:3],
QC[0:3],
QSYNC,
QFB
相關PDF資料 |
PDF描述 |
|---|---|
| ICS87973DYILFT | IC CLK MULT/ZD BUFFER 52-LQFP |
| ICS87974CYILF | IC CLK GEN LVCMOS/LVTTL 52-LQFP |
| ICS894D115AGI-04LF | IC CLK/DATA RECOVERY 20-TSSOP |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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