÷4/÷5 DIFFERENTIAL-
參數資料
型號: ICS87354AMILF
廠商: IDT, Integrated Device Technology Inc
文件頁數: 14/15頁
文件大小: 0K
描述: IC CLK GEN 3.3V LVPECL 8-SOIC
標準包裝: 97
系列: HiPerClockS™
類型: 時鐘發(fā)生器
PLL:
輸入: HCSL,LVDS,LVHSTL,LVPECL,SSTL
輸出: LVPECL
電路數: 1
比率 - 輸入:輸出: 1:1
差分 - 輸入:輸出: 是/是
頻率 - 最大: 1GHz
除法器/乘法器: 是/無
電源電壓: 3 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 8-SOIC(0.154",3.90mm 寬)
供應商設備封裝: 8-SOIC
包裝: 管件
其它名稱: 87354AMILF
87354AMI
www.idt.com
REV. A AUGUST 5, 2010
8
ICS87354I
÷4/÷5 DIFFERENTIAL-TO-
3.3V LVPECL CLOCK GENERATOR
V
CC - 2V
50
Ω
50
Ω
RTT
Z
o = 50Ω
Z
o = 50Ω
FOUT
FIN
RTT =
Z
o
1
((V
OH + VOL) / (VCC – 2)) – 2
3.3V
125
Ω
125
Ω
84
Ω
84
Ω
Z
o = 50Ω
Z
o = 50Ω
FOUT
FIN
The clock layout topology shown below is a typical termi-
nation for LVPECL outputs. The two different layouts men-
tioned are recommended only as guidelines.
FOUT and nFOUT are low impedance follower outputs that
generate ECL/LVPECL compatible outputs. Therefore, ter-
minating resistors (DC current path to ground) or current
sources must be used for functionality. These outputs are
designed to drive 50
Ω transmission lines. Matched imped-
ance techniques should be used to maximize operating
frequency and minimize signal distortion.
Figures 3A and
3B show two different layouts which are recommended only
as guidelines. Other suitable clock layouts may exist and it
would be recommended that the board designers simulate
to guarantee compatibility across all printed circuit and
clock component process variations.
TERMINATION FOR 3.3V LVPECL OUTPUT
FIGURE 3B. LVPECL OUTPUT TERMINATION
FIGURE 3A. LVPECL OUTPUT TERMINATION
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PDF描述
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參數描述
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