FEMTOCLOCK CRYSTAL-TO-LVDS CLOCK GENERATOR ICS844201BKI" />
參數(shù)資料
型號(hào)： ICS844201BG-45LF
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 11/16頁(yè)
文件大?。?/td> 0K
描述： IC CLK GENERATOR 25MHZ 8TSSOP
標(biāo)準(zhǔn)包裝： 96
系列： HiPerClockS™, FemtoClock™, PCI Express® (PCIe)
類型： 時(shí)鐘/頻率發(fā)生器，合成器
PLL： 是
主要目的： PCI Express（PCIe）
輸入： 晶體
輸出： LVDS
電路數(shù)： 1
比率 - 輸入:輸出： 1:1
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 125MHz
電源電壓： 2.97 V ~ 3.63 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 8-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 8-TSSOP
包裝： 管件
ICS844201I-45 Data Sheet
FEMTOCLOCK CRYSTAL-TO-LVDS CLOCK GENERATOR
ICS844201BKI-45 REVISION A OCTOBER 7, 2013
4
2013 Integrated Device Technology, Inc.
AC Electrical Characteristics
Table 5. AC Characteristics, VDD = 3.3V ± 10%, TA = -40°C to 85°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the device is
mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after thermal equilibrium
has been reached under these conditions.
NOTE: Characterized using a 25MHz crystal.
NOTE 1: Refer to Phase Noise Plots.
NOTE 2: Peak-to-Peak jitter after applying system transfer function for the Common Clock Architecture. Maximum limit for PCI Express Gen 1
is 86ps peak-to-peak for a sample size of 106 clock periods. See IDT Application Note PCI Express Reference Clock Requirements and also
the PCI Express Application section of this datasheet which show each individual transfer function and the overall composite transfer function.
NOTE 3: RMS jitter after applying the two evaluation bands to the two transfer functions defined in the Common Clock Architecture and
reporting the worst case results for each evaluation band. Maximum limit for PCI Express Generation 2 is 3.1ps rms for tREFCLK_HF_RMS
(High Band) and 3.0 ps RMS for tREFCLK_LF_RMS (Low Band). See IDT Application Note PCI Express Reference Clock Requirements and also
the PCI Express Application section of this datasheet which show each individual transfer function and the overall composite transfer function.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency
125
MHz
100
MHz
tjit()
RMS Phase Jitter,
Random; NOTE 1
125MHz, Integration Range:
12kHz – 20MHz
0.773
ps
100MHz, Integration Range:
12kHz – 20MHz
0.792
ps
tj
Phase Jitter
Peak-to-Peak;
NOTE 2
125MHz, (1.2MHz – 21.9MHz)
25MHz crystal input
Evaluation Band: 0Hz - Nyquist
(clock frequency/2)
12.51
ps
100MHz, (1.2MHz – 21.9MHz)
25MHz crystal input
Evaluation Band: 0Hz - Nyquist
(clock frequency/2)
13.48
ps
tREFCLK_HF_RMS
Phase Jitter RMS;
NOTE 3
125MHz, (1.2MHz – 21.9MHz)
25MHz crystal input
High Band: 1.5MHz - Nyquist
(clock frequency/2)
1.13
ps
100MHz, (1.2MHz – 21.9MHz)
25MHz crystal input
High Band: 1.5MHz - Nyquist
(clock frequency/2)
1.25
ps
tREFCLK_LF_RMS
Phase Jitter RMS;
NOTE 3
125MHz, (1.2MHz – 21.9MHz)
25MHz crystal input
Low Band: 10kHz - 1.5MHz
0.32
ps
100MHz, (1.2MHz – 21.9MHz)
25MHz crystal input
Low Band: 10kHz - 1.5MHz
0.33
ps
tR / tF
Output Rise/Fall Time
20% to 80%
250
450
ps
odc
Output Duty Cycle
fOUT = 125MHz
48
52
%
fOUT = 100MHz
46
54
%
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PDF描述
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