FEMTOCLOCK<" />
參數(shù)資料
型號： ICS844004AKI-104LFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 4/18頁
文件大?。?/td> 0K
描述： IC SYNTHESIZER LVDS 32-VFQFPN
標準包裝： 2,500
系列： HiPerClockS™, FemtoClock™
類型： 頻率合成器
PLL： 帶旁路
輸入： LVCMOS，LVTTL，晶體
輸出： LVDS
電路數(shù)： 1
比率 - 輸入:輸出： 2:4
差分 - 輸入:輸出： 無/是
頻率 - 最大： 226.66MHz
除法器/乘法器： 是/無
電源電壓： 2.375 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 32-VFQFPN 裸露焊盤（4x4）
包裝： 帶卷 (TR)
其它名稱： 844004AKI-104LFT
ICS844004AKI-104 REVISION A DECEMBER 15, 2010
12
2010 Integrated Device Technology, Inc.
ICS844004I-104 Data Sheet
FEMTOCLOCK CRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER
Schematic Example
Figure 6 shows an example of ICS844004I-104 application
schematic. In this example, the device is operated at VDD = VDDO =
3.3V. The 18pF parallel resonant 25MHz crystal is used. The C1 =
33pF and C2 = 27pF are recommended for frequency accuracy. For
different board layouts, the C1 and C2 may be slightly adjusted for
optimizing frequency accuracy. Two examples of LVDS for receiver
without built-in termination are shown in this schematic.
Figure 6. ICS844004I-104 Schematic Layout
R1
33
nQ0
Alternate
LVDS
Termination
C3
0.1uF
nQ
0
R3
50
To Logic
Input
pins
C4
0.1uF
C8
.1uf
nPLL_SEL
Logic Control Input Examples
R2
100
Set Logic
Input to
'1'
VDDA
U1
ICS844004-104
1
2
3
4
5
6
7
8
9 10 11 12 13 14 15 16
17
18
19
20
21
22
23
24
32 31 30 29 28 27 26 25
Q0
nQ0
MR
nPLL_SEL
nc
VD
D
A
F
_
SEL
0
VD
D
F
_
SEL
1
XT
AL
_O
U
T
XT
AL
_I
N
nc nc
GND
REF_CLK
nXTAL_SEL
nc
GND
nQ3
Q3
VD
D
O Q1
nQ
1
nc nc
nQ
2
Q2
VD
D
O
R1
10
VDD=3.3V
RD2
1K
REF_CLK
Zo = 50 Ohm
RU2
Not Install
R4
50
C1
33pF
nQ3
Q3
Zo = 50 Ohm
MR
VDD
nXTAL_SEL
VDD
Q3
Zo = 50 Ohm
nQ3
RD1
Not Install
Zo = 50 Ohm
X1
25MHz
Q1
Driv er_LVCMOS
RU1
1K
F_SEL0
C5
0.01u
To Logic
Input
pins
VDDO
VDD
Q0
C2
27pF
+
-
Set Logic
Input to
'0'
VDDO
+
-
C7
0.1uF
VDD
C6
10uF
F_SEL1
1 8 p F
Q0
VDDO=3.3V
Zo = 50
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