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參數(shù)資料
| 型號： | ICS844002AGI-01LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 14/14頁 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER 2LVDS 20-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | 時鐘，晶體 |
| 輸出： | LVDS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 170MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.375 V ~ 2.625 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 20-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 844002AGI-01LFT |
ICS844002I-01
FEMTOCLOCKS CRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER
IDT / ICS LVDS FREQUENCY SYNTHESIZER
9
ICS844002AGI-01 REV. D OCTOBER 20, 2008
2.5V LVDS Driver Termination
Figure 4 shows a typical termination for LVDS driver in
characteristic impedance of 100
differential (50 single)
transmission line environment. For buffer with multiple LVDS driver,
it is recommended to terminate the unused outputs.
Figure 4. Typical LVDS Driver Termination
2.5V
LVDS Driver
R1
100
–
+
2.5V
50
50
100
Differential Transmission Line
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PDF描述 |
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