參數(shù)資料
型號(hào)： ICS813078BYILF
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 24/26頁(yè)
文件大?。?/td> 0K
描述： IC VCXO PLL WIRELESS 64TQFP
標(biāo)準(zhǔn)包裝： 160
系列： HiPerClockS™, FemtoClock™
類型： 時(shí)鐘/頻率發(fā)生器，扇出緩沖器（分配），抖動(dòng)衰減器，多路復(fù)用器
PLL： 是
主要目的： 無(wú)線基礎(chǔ)架構(gòu)應(yīng)用
輸入： LVDS，LVHSTL，LVPECL，晶體
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 3:9
差分 - 輸入:輸出： 是/是
頻率 - 最大： 614.4MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-TQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 64-TQFP-EP（10x10）
包裝： 托盤
ICS813078I
FEMTOCLOCKS VCXO-PLL FREQUENCY GENERATOR
FEMTOCLOCKS VCXO-PLL FREQUENCY GENERATOR
7
ICS813078BYI REV. A OCTOBER 6, 2008
Table 3I. Reset (nMR) Configuration Table
Table 3J. Output Disable (nSTOPA) Configuration Table.
Table 3K. Output Disable (nSTOPB) Configuration Table.
Table 3L. Output Disable (nSTOPC) Configuration Table.
Table 3M. PLL Lock Status Output (LOCK_DT) Configuration Table.
Input
Operation
nMR
0
The Femto-PLL is reset.
1 (default)
Normal operation.
Input
Operation
nSTOPA
0
QA[2:0]/nQA[2:0] outputs are stopped in logic LOW state. The assertion of nSTOPA is asynchronous
to the internal clock signal and may cause an output runt pulse.
1 (default)
Normal operation and outputs enabled.
Input
Operation
nSTOPB
0
QB[1:0] / nQB[1:0] outputs are stopped in logic LOW state. The assertion of nSTOPB is
asynchronous to the internal clock signal and may cause an output runt pulse.
1 (default)
Normal operation and outputs enabled.
Input
Operation
nSTOPC
0
QC[3:0] outputs are stopped in logic LOW state. The assertion of nSTOPC is asynchronous to the
internal clock signal and may cause an output runt pulse.
1 (default)
Normal operation and outputs enabled.
Conditions
Output
LOCK_DT
Locked
Constantly HIGH.
Unlocked
HIGH with occasional LOW pulses.
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PDF描述
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參數(shù)描述
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