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參數資料
| 型號： | ICS810525AGILF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 10/12頁 |
| 文件大小： | 0K |
| 描述： | IC VCXO-LVCMOS/LVTTL 16-TSSOP |
| 標準包裝： | 96 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 壓控晶體振蕩器（VCXO） |
| PLL： | 是 |
| 輸入： | LVCMOS，LVTTL |
| 輸出： | LVCMOS，LVTTL |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 2:1 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 25MHz |
| 除法器/乘法器： | 無/是 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 16-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | 810525AGILF |
IDT / ICS VCXO-TO-LVCMOS/LVTTL OUTPUT
7
ICS810525AGI REV. B FEBRUARY 24, 2009
ICS810525I
VCXO-TO-LVCMOS/LVTTL OUTPUT
SCHEMATIC EXAMPLE
Figure 1 shows an example of the ICS810525I application
schematic. In this example, the device is operated at V
DD
= 3.3V.
The decoupling capacitors should be located as close as
possible to the power pin. The input is driven by a 3.3V LVCMOS
driver. A 2-pole filter loop filter with Low LBW setting is used in
this example. It is recommended to refer to the ICS810525I
datasheet for more detail on loop filter values.
FIGURE 1. ICS810525I SCHEMATIC EXAMPLE
APPLICATION INFORMATION
R3
10
Q1
Driv er_LVCMOS
C7
0.1u
LF1
Zo = 50
X1
XTAL_OUT
Rs
1k
C2
TUNE
C3
0.01u
R2
33
VDDA
VDD
VDDO
VDD
Cs
10uF
C1
TUNE
Receiv er
VDD = VDDO = 3.3V
VDD
R1
33
Zo = 50
C4
10u
LF0
Cp
10nF
XTAL_IN
C6
0.1u
2-pole loop filter with low LBW Setting
Q
C5
0.1u
U2
ICS810525I
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
nc
GND
Q
VDDO
nc
VDDA
VDD
GND
XTAL_OUT
XTAL_IN
LF0
LF1
GND
CLK
VDD
LF0
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PDF描述 |
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