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參數資料
| 型號： | ICS511MLF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 8/11頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK MULTIPLIER PLL 8-SOIC |
| 產品培訓模塊： | Clock Distibution and Generation 1.0 |
| 標準包裝： | 97 |
| 系列： | LOCO™ |
| 類型： | 時鐘發(fā)生器 |
| PLL： | 是 |
| 輸入： | 時鐘，晶體 |
| 輸出： | CMOS |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 1:1 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 200MHz |
| 除法器/乘法器： | 無/是 |
| 電源電壓： | 3.135 V ~ 5.25 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應商設備封裝： | 8-SOIC |
| 包裝： | 管件 |
| 產品目錄頁面： | 1251 (CN2011-ZH PDF) |
| 其它名稱： | 511MLF 800-1040 800-1040-5 800-1040-ND |
ICS511
LOCO PLL CLOCK MULTIPLIER
CLOCK MULTIPLIER
IDT / ICS LOCO PLL CLOCK MULTIPLIER
6
ICS511
REV K 051310
DC Electrical Characteristics
VDD=5.0 V ±5% , Ambient temperature -40 to +85
° C, unless stated otherwise
AC Electrical Characteristics
VDD = 5.0 V ±5%, Ambient Temperature -40 to +85
° C, unless stated otherwise
Note 1: Measured with 15 pF load.
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
4.75
5.25
V
Input High Voltage, ICLK only
VIH
ICLK (pin 1)
(VDD/2)+1
V
Input Low Voltage, ICLK only
VIL
ICLK (pin 1)
(VDD/2)-1
V
Input High Voltage
VIH
OE (pin 7)
2.0
V
Input Low Voltage
VIL
OE (pin 7)
0.8
V
Input High Voltage
VIH
S0, S1
VDD-0.5
V
Input Low Voltage
VIL
S0, S1
0.5
V
Output High Voltage
VOH
IOH = -25 mA
2.4
V
Output Low Voltage
VOL
IOL = 25 mA
0.4
V
IDD Operating Supply Current,
20 MHz crystal
No load, 100M
9
mA
Short Circuit Current
CLK output
+70
mA
On-Chip Pull-up Resistor
Pin 7
270
k
Input Capacitance, S1, S0, and OE
Pins 4, 6, 7
4
pF
Nominal Output Impedance
20
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency, crystal input
FIN
527
MHz
Input Frequency, clock input
FIN
250
MHz
Output Frequency
FOUT
0
° C to +70° C14
200
MHz
-40
° C to +85° C14
160
MHz
Output Clock Rise Time
tOR
0.8 to 2.0 V, Note 1
1
1.5
ns
Output Clock Fall Time
tOF
2.0 to 8.0 V, Note 1
1
1.5
ns
Output Clock Duty Cycle
tOD
1.5 V, up to 160 MHz
45
49-51
55
%
PLL Bandwidth
10
kHz
Output Enable Time, OE high to
output on
50
ns
Output Disable Time, OE low to
tri-state
50
ns
Absolute Clock Period Jitter
tja
Deviation from mean
+70
ps
One Sigma Clock Period Jitter
tjs
25
ps
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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