參數(shù)資料
型號(hào): ICS275PGLF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 3/10頁
文件大?。?/td> 0K
描述: VCXO CLK SYNTH TRPL PLL 16-TSSOP
標(biāo)準(zhǔn)包裝: 96
系列: VersaClock™
類型: 時(shí)鐘/頻率合成器,扇出緩沖器(分配)
PLL: 帶旁路
輸入: 晶體
輸出: CMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:4
差分 - 輸入:輸出: 無/無
頻率 - 最大: 200MHz
除法器/乘法器: 是/是
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 管件
其它名稱: 275PGLF
ICS275
TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER
EPROM VCXO AND SYNTHESIZER
IDT / ICS TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER 2
ICS275
REV E 081809
Pin Assignment
Pin Descriptions
13
4
12
5
11
VDD
8
9
10
GND
CLK3
CLK1
CLK4
16
3
S1
VIN
S2
PDTS
1
X1
S0
VDD
X2
14
2
7
GND
CLK2
VDD
15
6
16 pin (173 mil) TSSOP
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
VIN
Input
Voltage input to VCXO. Zero to 3.3V signal which controls the VCXO
frequency
2
S0
Input
Select pin 0. Internal pull-up resistor.
3
S1
Input
Select pin 1. Internal pull-up resistor.
4VDD
Power
Connect to +3.3 V.
5
CLK1
Output
Output clock 1. Weak internal pull-down when tri-state.
6
CLK2
Output
Output clock 2. Weak internal pull-down when tri-state.
7
GND
Power
Connect to ground.
8
X1
XI
Crystal input. Connect this pin to a crystal.
9
X2
XO
Crystal Output. Connect this pin to a crystal.
10
VDD
Power
Connect to +3.3 V.
11
CLK3
Output
Output clock 3. Weak internal pull-down when tri-state.
12
CLK4
Output
Output clock 4. Weak internal pull-down when tri-state.
13
GND
Power
Connect to ground.
14
PDTS
Input
Power-down tri-state. Powers down entire chip and tri-states clock outputs
when low. Internal pull-up resisitor.
15
VDD
Power
Connect to +3.3 V.
16
S2
Input
Select pin 2. Internal pull-up resisitor.
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PDF描述
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