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參數(shù)資料
| 型號(hào)： | HM628512CLTT-7 |
| 廠商： | Hitachi,Ltd. |
| 元件分類： | SRAM |
| 英文描述： | 4 M SRAM (512-kword x 8-bit) |
| 中文描述： | 四米的SRAM（512 - KWord的× 8位） |
| 文件頁(yè)數(shù)： | 7/17頁(yè) |
| 文件大?。?/td> | 84K |
| 代理商： | HM628512CLTT-7 |
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HM628512C Series
7
AC Characteristics
(Ta = –20 to +70
°
C, V
CC
= 5 V
±
10%, unless otherwise noted.)
Test Conditions
Input pulse levels: 0.8 V to 2.4 V
Input rise and fall time: 5 ns
Input and output timing reference levels: 1.5 V
Output load: 1 TTL Gate + C
L
(100 pF) (HM628512C-7)
1 TTL Gate + C
L
(50 pF) (HM628512C-5)
(Including scope & jig)
Read Cycle
HM628512C
-5
-7
Parameter
Symbol
Min
Max
Min
Max
Unit
Notes
Read cycle time
t
RC
t
AA
t
CO
t
OE
t
LZ
t
OLZ
t
HZ
t
OHZ
t
OH
55
—
70
—
ns
Address access time
—
55
—
70
ns
Chip select access time
—
55
—
70
ns
Output enable to output valid
—
25
—
35
ns
Chip selection to output in low-Z
10
—
10
—
ns
2
Output enable to output in low-Z
5
—
5
—
ns
2
Chip deselection to output in high-Z
0
20
0
25
ns
1, 2
Output disable to output in high-Z
0
20
0
25
ns
1, 2
Output hold from address change
10
—
10
—
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HM628512CLTT-7SL | Quadruple 2-Line To 1-Line Data Selectors/Multiplexers 16-CDIP -55 to 125 |
| HM628512CLRR-5SL | 4 M SRAM (512-kword x 8-bit) |
| HM628512CLRR-7 | 4 M SRAM (512-kword x 8-bit) |
| HM628512CLFP-5 | 4 M SRAM (512-kword x 8-bit) |
| HM628512CLFP-5SL | 4 M SRAM (512-kword x 8-bit) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| HM628512CLTT-7SL | 制造商:HITACHI 制造商全稱:Hitachi Semiconductor 功能描述:4 M SRAM (512-kword x 8-bit) |
| HM628512CLTTI-5 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Instructions for Using SRAM Devices Technical Update/Device |
| HM628512CLTTI-7 | 制造商:HITACHI 制造商全稱:Hitachi Semiconductor 功能描述:Wide Temperature Range Version 4 M SRAM (512-kword x 8-bit) |
| HM628512CSERIES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
| HM628512FP-10 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 SRAM |
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