參數(shù)資料
型號(hào)： HEF4044
廠商： NXP Semiconductors N.V.
英文描述： Quadruple R/S latch with 3-state outputs
中文描述： 四人間的R / S鎖存具有三態(tài)輸出
文件頁數(shù)： 4/5頁
文件大?。?/td> 47K
代理商： HEF4044
January 1995
4
Philips Semiconductors
Product specification
Quadruple R/S latch with 3-state outputs
HEF4044B
MSI
AC CHARACTERISTICS
V
SS
= 0 V; T
amb
= 25
°
C; C
L
= 50 pF; input transition times
≤
20 ns
V
DD
V
SYMBOL
MIN.
TYP. MAX.
TYPICAL EXTRAPOLATION
FORMULA
Propagation delays
R
n
→
O
n
HIGH to LOW
5
90
40
30
90
40
30
60
30
20
60
30
20
185 ns
80 ns
60 ns
180 ns
80 ns
60 ns
120 ns
60 ns
40 ns
120 ns
60 ns
40 ns
63 ns
+
(0,55 ns/pF) C
L
29 ns
+
(0,23 ns/pF) C
L
22 ns
+
(0,16 ns/pF) C
L
63 ns
+
(0,55 ns/pF) C
L
29 ns
+
(0,23 ns/pF) C
L
22 ns
+
(0,16 ns/pF) C
L
10 ns
+
(1,0 ns/pF) C
L
9 ns
+
(0,42 ns/pF) C
L
6 ns
+
(0,28 ns/pF) C
L
10 ns
+
(1,0 ns/pF) C
L
9 ns
+
(0,42 ns/pF) C
L
6 ns
+
(0,28 ns/pF) C
L
10
15
t
PHL
S
n
→
O
n
LOW to HIGH
5
10
15
t
PLH
Output transition
times
HIGH to LOW
5
10
15
5
10
15
t
THL
LOW to HIGH
t
TLH
3-state propagation delays
Output disable times
EO
→
O
n
HIGH
5
50
30
25
30
25
20
100 ns
60 ns
50 ns
60 ns
45 ns
40 ns
10
15
t
PHZ
5
LOW
10
15
t
PLZ
Output enable times
EO
→
O
n
HIGH
5
50
25
20
50
25
20
15
10
100 ns
50 ns
40 ns
95 ns
45 ns
35 ns
10
15
t
PZH
5
LOW
10
15
t
PZL
Minimum S
n
pulse width; LOW
5
30
20
16
30
20
16
ns
ns
ns
ns
ns
ns
see also waveforms
Fig.5
10
15
t
WSL
8
Minimum R
n
pulse width; LOW
5
15
10
10
15
t
WRL
8
相關(guān)PDF資料
PDF描述
HEF4044BD Quadruple R/S latch with 3-state outputs
HEF4044BF Quadruple R/S latch with 3-state outputs
HEF4044BN Quadruple R/S latch with 3-state outputs
HEF4046BD Programmable Logic Controller; RoHS Compliant: Yes
HEF4046BF Phase-locked loop
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參數(shù)描述
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