參數(shù)資料
型號(hào)： HEF4013BTD
廠商： NXP SEMICONDUCTORS
元件分類： 通用總線功能
英文描述： Dual D-type flip-flop
中文描述： 4000/14000/40000 SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14
封裝： PLASTIC, SOT-108, SO-14
文件頁(yè)數(shù)： 5/7頁(yè)
文件大?。?/td> 79K
代理商： HEF4013BTD
January 1995
5
Philips Semiconductors
Product specification
Dual D-type flip-flop
HEF4013B
flip-flops
AC CHARACTERISTI CS
V
SS
= 0 V; T
amb
= 25
°
C; C
L
= 50 pF; input transition times
≤
20 ns
V
DD
V
SYMBOL
MIN.
TYP.
MAX.
Set-up time
D
→
CP
5
40
25
15
20
20
15
60
30
20
50
24
20
50
24
20
15
15
15
40
25
25
7
14
20
20
10
5
0
0
0
30
15
10
25
12
10
25
12
10
5
0
0
25
10
10
14
28
40
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
MHz
MHz
MHz
see also waveforms
Figs 4 and 5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
t
su
Hold time
D
→
CP
t
hold
Minimum clock
pulse width; LOW
t
WCPL
Minimum S
D
pulse
width; HIGH
t
WSDH
Minimum C
D
pulse
width; HIGH
t
WCDH
Recovery time
for S
D
t
RSD
Recovery time
for C
D
t
RCD
Maximum clock
pulse frequency
f
max
V
DD
V
TYPICAL FORMULA FOR P (
μ
W)
Dynamic power
dissipation per
package (P)
5
850 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
3 600 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
9 000 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
where
f
i
= input freq. (MHz)
f
o
= output freq. (MHz)
C
L
= total load cap. (pF)
∑
(f
o
C
L
) = sum of outputs
V
DD
= supply voltage (V)
10
15
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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