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參數(shù)資料
| 型號： | HD49801FB |
| 廠商： | Electronic Theatre Controls, Inc. |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Digital Signal Processing IC for CCD Cameras |
| 中文描述： | 數(shù)字信號處理集成電路CCD相機 |
| 文件頁數(shù)： | 31/43頁 |
| 文件大小： | 185K |
| 代理商： | HD49801FB |
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Definition of H.REF
H.REF is the standard for determining:
— Memory R/W start/stop timing
— BF, CBLK, CSYNC pulse timing
Conditions required of H.REF
— H.REF is a pulse generated from the sensor clock (fs), and must be phase stable with respect to fs.
— It must be a continuous pulse with no missing pulse periods during the BLK or other period.
— Synchronization is horizontal scan synchronization.
— t
WH
= Min 2 fs
–1
— Timing corresponding to the effective pixel region for the falling edge of HREFI.
Min
t
F
t
B
30 fs
–1
0
H oweve , there are no special re q u ements when the fo owing re ationship is met: fs = 4n · f
H
(where n is an integer).
— Setting example for H synchronization pulses (for an NTSC 270,000 pixel CCD)
Name
Symbol
D10
D1
Notes
Values with respect to the falling edge of
HREFI.
H synchronization pulse 1
H1
10 0001 1011
539
H synchronization pulse 2
H2
00 1110 1100
236
H synchronization pulse 3
H3
0001 0110
22
H synchronization pulse 4
H4
0010 1110
46
H synchronization pulse 5
H5
0100 0011
67
H synchronization pulse 6
H6
0101 1010
90
H synchronization pulse 7
H7
0101 1111
95
H synchronization pulse 8
H8
0111 1000
120
H synchronization pulse 9
H9
1000 1011
138
When a 410,000 pixel CCD is used, the following timings, which are related to the sensor clock and the
sensor specifications, change.
— Memory R/W start/stop addresses
— BF, CBLK, CSYNC pulse timings
— Iris state data A13, H count 1 to 6
31
HD49801FB
HD49801FB
Values with respect to H synchronization
pulses 1 and 2.
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PDF描述 |
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