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參數(shù)資料
| 型號： | HD4046612 |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Low-Voltage AS Microcomputers with On-Chip DTMF Generation Circuit(帶雙音多頻電路的低電壓微計算機) |
| 中文描述： | 低電壓如同在微機芯片的DTMF產(chǎn)生電路（帶雙音多頻電路的低電壓微計算機） |
| 文件頁數(shù)： | 118/142頁 |
| 文件大?。?/td> | 894K |
| 代理商： | HD4046612 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁當前第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁
HD404669 Series
118
Table 26 Register-Register Instructions
Operation
Mnemonic
Operation Code
Function
Status
Words/
Cycles
Load A from B
LAB
0
0
0
1
0
0 1
0
0
0
B
→
A
1/1
Load B from A
LBA
0
0
1
1
0
0 1
0
0
0
A
→
B
1/1
Load A from W
LAW
0
0
1
0
0
0
0
0
0
0
0 0
0 0
0
0
0
0
0
0
W
→
A
2/2
*
Load A from Y
LAY
0
0
1
0
1
0 1
1
1
1
Y
→
A
1/1
Load A from SPX
LASPX
0
0
0
1
1
0 1
0
0
0
SPX
→
A
1/1
Load A from SPY
LASPY
0
0
0
1
0
1 1
0
0
0
SPY
→
A
1/1
Load A from MR
LAMR m
1
0
0
1
1
1 m
3
m
2
m
1
m
0
MR (m)
→
A
1/1
Exchange MR and A
XMRA m
1
0
1
1
1
1 m
3
m
2
m
1
m
0
MR (m)
A
1/1
Note:
*
The assembler automatically provides an operand for the second word of the LAW instruction.
Table 27 RAM Address Instructions
Operation
Mnemonic
Operation Code
Function
Status
Words/
Cycles
Load W from immediate
LWI i
0
0
1
1
1
1 0
0
i
1
i
0
i
→
W
1/1
Load X from immediate
LXI i
1
0
0
0
1
0 i
3
i
2
i
1
i
0
i
→
X
1/1
Load Y from immediate
LYI i
1
0
0
0
0
1 i
3
i
2
i
1
i
0
i
→
Y
1/1
Load W from A
LWA
0
0
1
0
0
0
0
0
0
0
1 0
0 0
0
0
0
0
0
0
A
→
W
2/2
*
Load X from A
LXA
0
0
1
1
1
0 1
0
0
0
A
→
X
1/1
Load Y from A
LYA
0
0
1
1
0
1 1
0
0
0
A
→
Y
1/1
Increment Y
IY
0
0
0
1
0
1 1
1
0
0
Y + 1
→
Y
NZ
1/1
Decrement Y
DY
0
0
1
1
0
1 1
1
1
1
Y – 1
→
Y
NB
1/1
Add A to Y
AYY
0
0
0
1
0
1 0
1
0
0
Y + A
→
Y
OVF
1/1
Subtract A from Y
SYY
0
0
1
1
0
1 0
1
0
0
Y – A
→
Y
NB
1/1
Exchange X and SPX
XSPX
0
0
0
0
0
0 0
0
0
1
X
SPX
1/1
Exchange Y and SPY
XSPY
0
0
0
0
0
0 0
0
1
0
Y
SPY
1/1
Exchange X and SPX,
Y and SPY
XSPXY
0
0
0
0
0
0 0
0
1
1
X
SPX,Y
SPY
1/1
Note:
*
The assembler automatically provides an operand for the second word of the LWA instruction.
相關PDF資料 |
PDF描述 |
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