參數(shù)資料
型號: FRONTPANEL2EK
廠商: Silicon Laboratories Inc
文件頁數(shù): 32/250頁
文件大?。?/td> 0K
描述: BOARD EVAL PROXIMITY F8XX SI1120
產品培訓模塊: Si1102 & Si1120
標準包裝: 1
系列: QuickSense™
傳感器類型: 觸摸,電容式
傳感范圍: 4 個按鈕/鍵
接口: USB
嵌入式: 是,MCU,8 位
已供物品: 板,線纜
已用 IC / 零件: C8051F800,Si1120
產品目錄頁面: 626 (CN2011-ZH PDF)
相關產品: 336-1820-1-ND - SENS IR PROXIMITY AMB LT 8-ODFN
其它名稱: 336-1816
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Rev. 1.0
127
C8051F80x-83x
21.5. Comparator0 Reset
Comparator0 can be configured as a reset source by writing a 1 to the C0RSEF flag (RSTSRC.5).
Comparator0 should be enabled and allowed to settle prior to writing to C0RSEF to prevent any turn-on
chatter on the output from generating an unwanted reset. The Comparator0 reset is active-low: if the non-
inverting input voltage (on CP0+) is less than the inverting input voltage (on CP0-), the device is put into
the reset state. After a Comparator0 reset, the C0RSEF flag (RSTSRC.5) will read 1 signifying
Comparator0 as the reset source; otherwise, this bit reads 0. The state of the RST pin is unaffected by this
reset.
21.6. PCA Watchdog Timer Reset
The programmable Watchdog Timer (WDT) function of the Programmable Counter Array (PCA) can be
used to prevent software from running out of control during a system malfunction. The PCA WDT function
can be enabled or disabled by software as described in Section “29.4. Watchdog Timer Mode” on
page 236; the WDT is enabled and clocked by SYSCLK / 12 following any reset. If a system malfunction
prevents user software from updating the WDT, a reset is generated and the WDTRSF bit (RSTSRC.5) is
set to ‘1’. The state of the RST pin is unaffected by this reset.
21.7. Flash Error Reset
If a Flash read/write/erase or program read targets an illegal address, a system reset is generated. This
may occur due to any of the following:
A Flash write or erase is attempted above user code space. This occurs when PSWE is set to 1 and a
MOVX write operation targets an address above address 0x3DFF.
A Flash read is attempted above user code space. This occurs when a MOVC operation targets an
address above address 0x3DFF.
A Program read is attempted above user code space. This occurs when user code attempts to branch
to an address above 0x3DFF.
A Flash read, write or erase attempt is restricted due to a Flash security setting (see Section
The FERROR bit (RSTSRC.6) is set following a Flash error reset. The state of the RST pin is unaffected by
this reset.
21.8. Software Reset
Software may force a reset by writing a 1 to the SWRSF bit (RSTSRC.4). The SWRSF bit will read 1 fol-
lowing a software forced reset. The state of the RST pin is unaffected by this reset.
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PDF描述
EEC18DRTS-S734 CONN EDGECARD 36POS DIP .100 SLD
0150150229 CABLE FLAT FLEX 29POS .3MM 2"
VE-J74-EZ CONVERTER MOD DC/DC 48V 25W
0210490793 CABLE JUMPER 1.25MM .076M 11POS
NC-381381-2.5-9 LABEL ID PRODUCT
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參數(shù)描述
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