參數(shù)資料
型號： EVAL-AD7991EBZ
廠商： Analog Devices Inc
文件頁數(shù)： 25/28頁
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描述： BOARD EVAL FOR AD7991
標(biāo)準(zhǔn)包裝： 1
ADC 的數(shù)量： 1
位數(shù)： 12
采樣率（每秒）： 1M
數(shù)據(jù)接口： 串行
輸入范圍： 0 ~ Vdd
在以下條件下的電源（標(biāo)準(zhǔn)）： 4.4mW @ 5.5V，3.4MHz
工作溫度： -40°C ~ 125°C
已用 IC / 零件： AD7991
已供物品： 板，纜線，CD
產(chǎn)品目錄頁面： 780 (CN2011-ZH PDF)
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AD7991YRJZ-0500RL7TR-ND - IC ADC 12BIT 4CH SAR I2C SOT23-8
AD7991/AD7995/AD7999
Rev. B | Page 6 of 28
A Version2
Y Version
Parameter
Min
Typ
Max
Min
Typ
Max
Unit
Test Conditions/Comments
LOGIC INPUTS (SDA, SCL)
Input High Voltage, VINH
0.7 (VDD)
V
VDD = 2.7 V to 5.5 V
0.9 (VDD)
V
VDD = 2.35 V to 2.7 V
Input Low Voltage, VINL
0.3 (VDD)
V
VDD = 2.7 V to 5.5 V
0.1 (VDD)
V
VDD = 2.35 V to 2.7 V
Input Leakage Current, IIN
±1
μA
VIN = 0 V or VDD
Input Capacitance, CIN7
10
pF
Input Hysteresis, VHYST
0.1 (VDD)
V
LOGIC OUTPUTS (OPEN
DRAIN)
Output Low Voltage, VOL
0.4
V
ISINK = 3 mA
0.6
V
ISINK = 6 mA
Floating-State Leakage
Current
±1
μA
Floating-State Output
10
pF
Output Coding
Straight (natural) binary
THROUGHPUT RATE
18 × (1/fSCL)
fSCL ≤ 1.7 MHz; see the
section
17.5 × (1/fSCL) +
2 μs
17.5 × (1/fSCL) +
2 μs
fSCL > 1.7 MHz; see the
section
POWER REQUIREMENTS3
VREF = VDD; for fSCL = 3.4 MHz,
clock stretching is implemented
VDD
2.7
5.5
2.7
5.5
V
IDD
Digital inputs = 0 V or VDD
0.09/0.25
mA
VDD = 3.3 V/5.5 V, 400 kHz fSCL
ADC Operating,
Interface Active
(Fully Operational)
0.25
0.25/0.8
mA
VDD = 3.3 V/5.5 V, 3.4 MHz fSCL
0.07/0.16
mA
VDD = 3.3 V/5.5 V, 400 kHz fSCL
Power-Down, Interface
0.26
0.26/0.85
mA
VDD = 3.3 V/5.5 V, 3.4 MHz fSCL
Power-Down, Interface
1
1/1.6
μA
VDD = 3.3 V/5.5 V
Power Dissipation
0.3/1.38
mW
VDD = 3.3 V/5.5 V, 400 kHz fSCL
ADC Operating,
Interface Active
(Fully Operational)
0.83
0.83/4.4
mW
VDD = 3.3 V/5.5 V, 3.4 MHz fSCL
0.24/0.88
mW
VDD = 3.3 V/5.5 V, 400 kHz fSCL
Power-Down, Interface
0.86
0.86/4.68
mW
VDD = 3.3 V/5.5 V, 3.4 MHz fSCL
Power-Down, Interface
3.3
3.3/8.8
μW
VDD = 3.3 V/5.5 V
1 Functional from VDD = 2.35 V.
2 A Version tested at VDD = 3.3 V and fSCL = 3.4 MHz. Functionality tested at fSCL = 400 kHz.
3 Sample delay and bit trial delay enabled, t1 = t2 = 0.5/fSCL.
4 For fSCL up to 400 kHz, clock stretching is not implemented. Above fSCL = 400 kHz, clock stretching is implemented.
5 See the Terminology section.
6 For fSCL ≤ 1.7 MHz, clock stretching is not implemented; for fSCL > 1.7 MHz, clock stretching is implemented.
7 Guaranteed by initial characterization.
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PDF描述
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參數(shù)描述
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EVAL-AD7992EBZ 功能描述:BOARD EVALUATION FOR AD7992 RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評估板 - 模數(shù)轉(zhuǎn)換器 (ADC) 系列:- 產(chǎn)品培訓(xùn)模塊:Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- ADC 的數(shù)量:1 位數(shù):12 采樣率（每秒）:94.4k 數(shù)據(jù)接口:USB 輸入范圍:±VREF/2 在以下條件下的電源（標(biāo)準(zhǔn)）:- 工作溫度:-40°C ~ 85°C 已用 IC / 零件:MAX11645 已供物品:板，軟件
EVAL-AD7993CB 制造商:Analog Devices 功能描述:EVALUATION CONTROL BOARD. - Bulk
EVAL-AD7993CBZ 制造商:Analog Devices 功能描述:EVALUATION CONTROL BOARD. - Bulk
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