VDD1 = 4.5 V to 5.25 V, V" />
參數(shù)資料
型號： EVAL-AD7400EDZ
廠商： Analog Devices Inc
文件頁數(shù)： 15/20頁
文件大?。?/td> 0K
描述： BOARD EVAL AD7400
標準包裝： 1
系列： iCoupler®
ADC 的數(shù)量： 1
位數(shù)： 16
采樣率（每秒）： 10M
數(shù)據(jù)接口： 串行
輸入范圍： ±320 mV
在以下條件下的電源（標準）： 90mW @ 10MSPS
工作溫度： -40°C ~ 105°C
已用 IC / 零件： AD7400
已供物品： 板
AD7400
Data Sheet
Rev. G | Page 4 of 20
TIMING SPECIFICATIONS
VDD1 = 4.5 V to 5.25 V, VDD2 = 3 V to 5.5 V, TA = TMAX to TMIN, unless otherwise noted.1
Table 2.
Parameter
Limit at TMIN, TMAX
Unit
Description
fMCLKOUT2
10
MHz typ
Master clock output frequency
9/11
MHz min/MHz max
Master clock output frequency
40
ns max
Data access time after MCLK rising edge
10
ns min
Data hold time after MCLK rising edge
t3
0.4 × tMCLKOUT
ns min
Master clock low time
t4
0.4 × tMCLKOUT
ns min
Master clock high time
1 Sample tested during initial release to ensure compliance.
2 Mark space ratio for clock output is 40/60 to 60/40.
3 Measured with the load circuit of Figure 2 and defined as the time required for the output to cross 0.8 V or 2.0 V.
04
71
8-
00
2
200A
IOL
200A
IOH
+1.6V
TO OUTPUT
PIN
CL
25pF
Figure 2. Load Circuit for Digital Output Timing Specifications
04718-003
MCLKOUT
MDAT
t1
t2
t4
t3
Figure 3. Data Timing
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PDF描述
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