參數(shù)資料
型號(hào)： EPM3128ATC144-5
英文描述： Electrically-Erasable Complex PLD
中文描述： 電可擦除復(fù)雜可編程邏輯器件
文件頁(yè)數(shù)： 24/53頁(yè)
文件大?。?/td> 839K
代理商： EPM3128ATC144-5
30
Altera Corporation
MAX 3000A Programmable Logic Device Family Data Sheet
Table 17. EPM3128A External Timing Parameters
Symbol
Parameter
Conditions
Speed Grade
Unit
-5
-7
-10
Min
Max
Min
Max
Min
Max
tPD1
Input to non-
registered output
C1 = 35 pF
5.0
7.5
10
ns
tPD2
I/O input to non-
registered output
C1 = 35 pF
5.0
7.5
10
ns
tSU
Global clock setup
time
3.3
4.9
6.6
ns
tH
Global clock hold time (2)
0.0
ns
tCO1
Global clock to output
delay
C1 = 35 pF
1.0
3.4
1.0
5.0
1.0
6.6
ns
tCH
Global clock high time
2.0
3.0
4.0
ns
tCL
Global clock low time
2.0
3.0
4.0
ns
tASU
Array clock setup time (2)
1.8
2.8
3.8
ns
tAH
Array clock hold time
0.2
0.3
0.4
ns
tACO1
Array clock to output
delay
C1 = 35 pF
1.0
4.9
1.0
7.1
1.0
9.4
ns
tACH
Array clock high time
2.0
3.0
4.0
ns
tACL
Array clock low time
2.0
3.0
4.0
ns
tCPPW
Minimum pulse width
for clear and preset
2.0
3.0
4.0
ns
tCNT
Minimum global clock
period
5.2
7.7
10.2
ns
fCNT
Maximum internal
global clock frequency
192.3
129.9
98.0
MHz
tACNT
Minimum array clock
period
5.2
7.7
10.2
ns
fACNT
Maximum internal
array clock frequency
192.3
129.9
98.0
MHz
相關(guān)PDF資料
PDF描述
EPM3128ATC144-7
EPM7032AELC44-10
EPM7032AELC44-4
EPM7032AELC44-7
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參數(shù)描述
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