參數資料
型號： EP4CE6F17C8
廠商： Altera
文件頁數： 10/42頁
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描述： IC CYCLONE IV FPGA 6K 256FBGA
產品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
Cyclone IV FPGA Family Overview
特色產品： Cyclone? IV FPGAs
標準包裝： 90
系列： CYCLONE® IV E
LAB/CLB數： 392
邏輯元件/單元數： 6272
RAM 位總計： 276480
輸入/輸出數： 179
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 256-BGA
供應商設備封裝： 256-FBGA（17x17）
1–18
Chapter 1: Cyclone IV Device Datasheet
Switching Characteristics
December 2013
Altera Corporation
Receiver
Supported I/O
Standards
1.4 V PCML,
1.5 V PCML,
2.5 V PCML,
LVPECL, LVDS
Data rate (F324 and
smaller package) (15)
—
600
—
2500
600
—
2500
600
—
2500
Mbps
Data rate (F484 and
larger package) (15)
—
600
—
3125
600
—
3125
600
—
2500
Mbps
Absolute VMAX for a
receiver pin (3)
—
1.6
—
1.6
—
1.6
V
Operational VMAX for
a receiver pin
—
1.5
—
1.5
—
1.5
V
Absolute VMIN for a
receiver pin
—
–0.4
—
–0.4
—
–0.4
—
V
Peak-to-peak
differential input
voltage VID (diff p-p)
VICM = 0.82 V
setting, Data Rate
= 600 Mbps to
3.125 Gbps
0.1
—
2.7
0.1
—
2.7
0.1
—
2.7
V
VICM
VICM = 0.82 V
setting
—
820 ±
10%
——
820 ±
10%
——
820 ±
10%
—mV
Differential on-chip
termination resistors
100
setting
—
100
—
100
—
100
—
150
setting
—
150
—
150
—
150
—
Differential and
common mode
return loss
PIPE, Serial
Rapid I/O SR,
SATA, CPRI LV,
SDI, XAUI
Compliant
—
Programmable ppm
detector (4)
—
± 62.5, 100, 125, 200,
250, 300
ppm
Clock data recovery
(CDR) ppm
tolerance (without
spread-spectrum
clocking enabled)
——
—
±300 (5),
±350
——
±300
±350
——
±300
±350
ppm
CDR ppm tolerance
(with synchronous
spread-spectrum
clocking enabled) (8)
——
—
350 to
–5350
——
350 to
–5350
——
350 to
–5350
ppm
Run length
—
80
—
80
—
80
—
UI
Programmable
equalization
No Equalization
—
1.5
—
1.5
—
1.5
dB
Medium Low
—
4.5
—
4.5
—
4.5
dB
Medium High
—
5.5
—
5.5
—
5.5
dB
High
—
7
—
7
—
7
dB
Table 1–21. Transceiver Specification for Cyclone IV GX Devices (Part 2 of 4)
Symbol/
Description
Conditions
C6
C7, I7
C8
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
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