- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄4351 > EP2SGX60CF780C5 (Altera)IC STRATIX II GX 60K 780-FBGA PDF資料下載
參數(shù)資料
| 型號： | EP2SGX60CF780C5 |
| 廠商： | Altera |
| 文件頁數(shù)： | 735/1486頁 |
| 文件大小： | 0K |
| 描述： | IC STRATIX II GX 60K 780-FBGA |
| 產(chǎn)品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 9 |
| 系列： | Stratix® II GX |
| LAB/CLB數(shù)： | 3022 |
| 邏輯元件/單元數(shù)： | 60440 |
| RAM 位總計： | 2544192 |
| 輸入/輸出數(shù)： | 364 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 780-BBGA |
| 供應商設備封裝： | 780-FBGA（29x29） |
| 其它名稱： | 544-1757 |
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April 2006, v3.0
● Updated Table 6–3.
● Updated Table 6–5.
● Updated Table 6–7.
● Added Table 6–42.
● Updated “Internal Timing Parameters” section
(Tables 6–43 through 6–48).
● Updated “Stratix II GX Clock Timing
Parameters” section (Tables 6–49 through
6–65).
● Updated “IOE Programmable Delay” section
(Tables 6–67 and 6–68)
● Updated “I/O Delays” section (Tables 6–71
through 6–74.
● Updated “Maximum Input & Output Clock Toggle
Rate” section. Replaced tables 6-73 and 6-74
with Tables 6–75 through 6–83. Input and output
clock rates for row, column, and dedicated clock
pins are now in separate tables.
February 2006,
v2.1
● Updated Tables 6–4 and 6–5.
● Updated Tables 6–49 through 6–65 (removed
column designations for industrial/commercial
and removed industrial numbers).
December 2005,
v2.0
Updated timing numbers.
October 2005
v1.1
● Updated Table 6–7.
● Updated Table 6–38.
● Updated 3.3-V PCML information and notes to
Tables 6–73 through 6–76.
● Minor textual changes throughout the
document.
October 2005
v1.0
Added chapter to the Stratix II GX Device
Handbook.
Table 4–118. Document Revision History (Part 5 of 5)
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