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參數(shù)資料
| 型號： | EP20K400FC672-3ES |
| 英文描述： | FPGA |
| 中文描述： | FPGA的 |
| 文件頁數(shù)： | 112/114頁 |
| 文件大小： | 1623K |
| 代理商： | EP20K400FC672-3ES |
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Altera Corporation
97
APEX 20K Programmable Logic Device Family Data Sheet
Table 80. EP20K200E Minimum Pulse Width Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tCH
1.36
2.44
2.65
ns
tCL
1.36
2.44
2.65
ns
tCLRP
0.18
0.19
0.21
ns
tPREP
0.18
0.19
0.21
ns
tESBCH
1.36
2.44
2.65
ns
tESBCL
1.36
2.44
2.65
ns
tESBWP
1.18
1.48
1.76
ns
tESBRP
0.95
1.17
1.41
ns
Table 81. EP20K200E External Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.24
2.35
2.47
ns
tINH
0.00
ns
tOUTCO
2.00
5.12
2.00
5.62
2.00
6.11
ns
tINSUPLL
2.13
2.07
-
ns
tINHPLL
0.00
-
ns
tOUTCOPLL
0.50
3.01
0.50
3.36
-
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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