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參數(shù)資料
| 型號： | EP20K200RC240-1ES |
| 英文描述： | FPGA |
| 中文描述： | FPGA的 |
| 文件頁數(shù)： | 11/114頁 |
| 文件大?。?/td> | 1623K |
| 代理商： | EP20K200RC240-1ES |
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108
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Note to Tables 101 - 106:
(1)
The timing information for these tables is preliminary.
ESB Timing Microparameters, fMAX Routing Delays, Minimum Pulse
Width Timing Parameters, External Timing Parameters, and External
Bidirectional Timing Parameters for EP20K1500E APEX 20KE devices.
Table 106. EP20K1000E External Bidirectional Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tINSUBIDIR
2.49
2.56
2.55
ns
tINHBIDIR
0.00
ns
tOUTCOBIDIR
2.00
5.18
2.00
5.75
2.00
6.25
ns
tXZBIDIR
7.39
8.28
9.21
ns
tZXBIDIR
7.39
8.28
9.21
ns
tINSUBIDIRPLL
3.27
3.35
ns
tINHBIDIRPLL
0.00
ns
tOUTCOBIDIRPLL
0.50
1.86
0.50
2.03
ns
tXZBIDIRPLL
4.06
4.56
ns
tZXBIDIRPLL
4.06
4.56
ns
Table 107. EP20K1500E fMAX LE Timing Microparameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tSU
0.26
0.27
ns
tH
0.26
0.27
ns
tCO
0.29
0.34
0.36
ns
tLUT
0.81
0.97
1.15
ns
相關PDF資料 |
PDF描述 |
|---|---|
| EP20K200RC240-2 | Field Programmable Gate Array (FPGA) |
| EP20K200RC240-2ES | FPGA |
| EP20K200RC240-3 | Field Programmable Gate Array (FPGA) |
| EP20K200RC240-3ES | FPGA |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| EP20K200RC240-1X | 功能描述:FPGA - 現(xiàn)場可編程門陣列 CPLD - APEX 20K 832 Macro 174 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP20K200RC240-2 | 制造商:Altera Corporation 功能描述:IC APEX 20K FPGA 240RQFP 制造商:Altera Corporation 功能描述:IC FPGA 174 I/O 240RQFP |
| EP20K200RC240-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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