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參數(shù)資料
| 型號： | EP20K200QI240-3ES |
| 英文描述： | FPGA |
| 中文描述： | FPGA的 |
| 文件頁數(shù)： | 107/114頁 |
| 文件大?。?/td> | 1623K |
| 代理商： | EP20K200QI240-3ES |
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92
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Table 68. EP20K100E Minimum Pulse Width Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tCH
2.00
ns
tCL
2.00
ns
tCLRP
0.20
ns
tPREP
0.20
ns
tESBCH
2.00
ns
tESBCL
2.00
ns
tESBWP
1.29
1.53
1.66
ns
tESBRP
1.11
1.29
1.41
ns
Table 69. EP20K100E External Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.23
2.32
2.43
ns
tINH
0.00
ns
tOUTCO
2.00
4.86
2.00
5.35
2.00
5.84
ns
tINSUPLL
1.58
1.66
-
ns
tINHPLL
0.00
-
ns
tOUTCOPLL
0.50
2.96
0.50
3.29
-
ns
Table 70. EP20K100E External Bidirectional Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSUBIDIR
2.74
2.96
3.19
ns
tINHBIDIR
0.00
ns
tOUTCOBIDIR
2.00
4.86
2.00
5.35
2.00
5.84
ns
tXZBIDIR
5.00
5.48
5.89
ns
tZXBIDIR
5.00
5.48
5.89
ns
tINSUBIDIRPLL
4.64
5.03
-
ns
tINHBIDIRPLL
0.00
-
ns
tOUTCOBIDIRPLL
0.50
2.96
0.50
3.29
-
ns
tXZBIDIRPLL
3.10
3.42
-
ns
tZXBIDIRPLL
3.10
3.42
-
ns
相關PDF資料 |
PDF描述 |
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