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參數資料
| 型號： | EP20K100TI144-3ES |
| 英文描述： | FPGA |
| 中文描述： | FPGA的 |
| 文件頁數： | 52/114頁 |
| 文件大小： | 1623K |
| 代理商： | EP20K100TI144-3ES |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁當前第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁
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Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Each IOE drives a row, column, MegaLAB, or local interconnect when
used as an input or bidirectional pin. A row IOE can drive a local,
MegaLAB, row, and column interconnect; a column IOE can drive the
column interconnect. Figure 27 shows how a row IOE connects to the
interconnect.
Figure 27. Row IOE Connection to the Interconnect
Row Interconnect
MegaLAB Interconnect
Any LE can drive a
pin through the row,
column, and MegaLAB
interconnect.
An LE can drive a pin through the
local interconnect for faster
clock-to-output times.
IOE
Each IOE can drive local,
MegaLAB, row, and column
interconnect. Each IOE data
and OE signal is driven by
the local interconnect.
LAB
相關PDF資料 |
PDF描述 |
|---|---|
| EP20K1500CB652C7 | ASIC |
| EP20K1500CB652C8 | ASIC |
| EP20K1500CB652C9 | ASIC |
| EP20K1500CB652I7 | ASIC |
| EP20K1500CB652I8 | ASIC |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP20K1500CB652C7 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| EP20K1500CB652C8 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| EP20K1500CB652C9 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| EP20K1500CB652I7 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| EP20K1500CB652I8 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
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