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參數(shù)資料
| 型號(hào)： | EP1S60F1020C7N |
| 廠商： | Altera |
| 文件頁數(shù)： | 108/864頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 60K LE 1020-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 產(chǎn)品變化通告： | Package Height Change 03/March/2008 |
| 標(biāo)準(zhǔn)包裝： | 8 |
| 系列： | Stratix® |
| LAB/CLB數(shù)： | 5712 |
| 邏輯元件/單元數(shù)： | 57120 |
| RAM 位總計(jì)： | 5215104 |
| 輸入/輸出數(shù)： | 773 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 1020-BBGA |
| 供應(yīng)商設(shè)備封裝： | 1020-FBGA（33x33） |
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4–16
Altera Corporation
Stratix Device Handbook, Volume 1
January 2006
Operating Conditions
Table 4–31. CTT I/O Specifications
Symbol
Parameter
Conditions
Minimum
Typical
Maximum
Unit
VCCIO
Output supply voltage
2.05
3.3
3.6
V
VTT/VREF
Termination and input
reference voltage
1.35
1.5
1.65
V
VIH
High-level input voltage
VREF + 0.2
V
VIL
Low-level input voltage
VREF – 0.2
V
VOH
High-level output voltage
IOH = –8 mA
VREF + 0.4
V
VOL
Low-level output voltage
IOL = 8 mA
VREF – 0.4
V
IO
Output leakage current
(when output is high Z)
GND
≤VOUT ≤
VCCIO
–10
10
μA
Table 4–32. Bus Hold Parameters
Parameter
Conditions
VCCIO Level
Unit
1.5 V1.8 V2.5 V3.3 V
Min
Max
Min
Max
Min
Max
Min
Max
Low sustaining
current
VIN > VIL
(maximum)
25
30
50
70
μA
High sustaining
current
VIN < VIH
(minimum)
-25
–30
–50
–70
μA
Low overdrive
current
0 V < VIN <
VCCIO
160
200
300
500
μA
High overdrive
current
0 V < VIN <
VCCIO
-160
–200
–300
–500
μA
Bus-hold trip
point
0.5
1.0
0.68
1.07
0.7
1.7
0.8
2.0
V
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