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參數(shù)資料
| 型號： | EP1S40B956C6N |
| 廠商： | Altera |
| 文件頁數(shù)： | 202/864頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 40K LE 956-BGA |
| 產(chǎn)品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 7 |
| 系列： | Stratix® |
| LAB/CLB數(shù)： | 4125 |
| 邏輯元件/單元數(shù)： | 41250 |
| RAM 位總計： | 3423744 |
| 輸入/輸出數(shù)： | 683 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 956-BGA |
| 供應商設備封裝： | 956-BGA覆晶式（40x40） |
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4–100
Altera Corporation
Stratix Device Handbook, Volume 1
January 2006
PLL Specifications
Tables 4–131 through 4–133 describe the Stratix device fast PLL
specifications.
Table 4–131. Fast PLL Specifications for -5 & -6 Speed Grade Devices
Symbol
Parameter
Min
Max
Unit
fIN
CLKIN
10
717
MHz
fINPFD
Input frequency to PFD
10
500
MHz
fOUT
Output frequency for internal global or
regional clock (3)
9.375
420
MHz
fOUT_DIFFIO
Output frequency for external clock
driven out on a differential I/O data
channel (2)
fVCO
VCO operating frequency
300
1,000
MHz
tINDUTY
CLKIN
duty cycle
40
60
%
tINJITTER
Period jitter for CLKIN pin
±200
ps
tDUTY
Duty cycle for DFFIO 1
× CLKOUT pin (6)
45
55
%
tJITTER
Period jitter for DIFFIO clock out (6)
ps
tLOCK
Time required for PLL to acquire lock
10
100
μs
m
Multiplication factors for m counter (6)
1
32
Integer
l0, l1, g0
Multiplication factors for l0, l1, and g0
counter (7), (8)
1
32
Integer
tARESET
Minimum pulse width on areset
signal
10
ns
Table 4–132. Fast PLL Specifications for -7 Speed Grades (Part 1 of 2)
Symbol
Parameter
Min
Max
Unit
fIN
CLKIN
frequency (1), (3)
10
640
MHz
fINPFD
Input frequency to PFD
10
500
MHz
fOUT
Output frequency for internal global or
regional clock (4)
9.375
420
MHz
fOUT_DIFFIO
Output frequency for external clock
driven out on a differential I/O data
channel
MHz
fVCO
VCO operating frequency
300
700
MHz
tINDUTY
CLKIN
duty cycle
40
60
%
tINJITTER
Period jitter for CLKIN pin
±200
ps
tDUTY
Duty cycle for DFFIO 1
× CLKOUT pin (6)
45
55
%
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PDF描述 |
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| EP1S40F1020C5N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 4125 LABs 773 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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