參數(shù)資料
型號： DS26519GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 201/310頁
文件大?。?/td> 0K
描述： IC TXRX T1/E1/J1 16PRT 484-HSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 30
類型： 收發(fā)器
驅(qū)動器/接收器數(shù)： 16/16
規(guī)程： 以太網(wǎng)
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 484-BGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 484-HSBGA（23x23）
包裝： 管件
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DS26519 16-Port T1/E1/J1 Transceiver
28 of 310
NAME
PIN
TYPE
FUNCTION
RCHBLK1/
RCHCLK1
F3
RCHBLK2/
RCHCLK2
G8
RCHBLK3/
RCHCLK3
H5
RCHBLK4/
RCHCLK4
Y7
RCHBLK5/
RCHCLK5
AA8
RCHBLK6/
RCHCLK6
AA11
RCHBLK7/
RCHCLK7
E18
RCHBLK8/
RCHCLK8
U20
RCHBLK9/
RCHCLK9
G7
RCHBLK10/
RCHCLK10
L15
RCHBLK11/
RCHCLK11
B2
RCHBLK12/
RCHCLK12
W4
RCHBLK13/
RCHCLK13
M6
RCHBLK14/
RCHCLK14
U17
RCHBLK15/
RCHCLK15
H14
RCHBLK16/
RCHCLK16
R16
Output
Receive Channel Block/Receive Channel Block Clock.
This pin can be
configured to output either RCHBLK or RCHCLK.
RCHBLK[1:16].
RCHBLKn is a user-programmable output that can be forced
high or low during any of the 24 T1 or 32 E1 channels. It is synchronous with
RCLKn when the receive-side elastic store is disabled. It is synchronous with
RSYSCLKn when the receive-side elastic store is enabled. This pin is useful for
blocking clocks to a serial UART or LAPD controller in applications where not all
channels are used such as fractional service, 384kbps service, 768kbps, or
ISDN-PRI. Also useful for locating individual channels in drop-and-insert
applications, for external per-channel loopback, and for per-channel conditioning.
RCHCLK[1:16].
RCHCLKn is a dual function pin that can output either a gapped
clock or a channel clock. In gapped clock mode, RCHCLKn is a N x 64kHz
fractional clock, which is software programmable for 0 to 24 channels and the
F-bit (T1) or 0 to 32 channels (E1). In channel clock mode, RCHCLKn is a
192kHz (T1) or 256kHz (E1) clock that pulses high during the LSB of each
channel. It is useful for parallel-to-serial conversion of channel data. In either
mode, RCHCLK is synchronous with RCLKn when the receive-side elastic store
is disabled or it is synchronous with RSYSCLKn when the receive-side elastic
store is enabled. The mode of RCHCLKn is determined by the RGCLKEN bit in
the RESCR register.
BPCLK1
H8
BPCLK2
R17
Output
Backplane Clock [1:2].
Programmable clock outputs that can be set to
2.048MHz, 4.096MHz, 8.192MHz, or 16.384MHz. The reference to these clocks
can be RCLK[8:1] for BPCLK1 and RCLK[9:16] for BPCLK2, a 1.544MHz or
2.048MHz clock frequency derived from MCLK, or an external reference clock
(REFCLKIO). This allows system clocks to be referenced from external sources,
the T1J1E1 recovered clocks, or the MCLK oscillator.
CLKO
C3
Output
Clock Out.
Clock output pin that can be programmed to output numerous
frequencies referenced to MCLK. Frequencies available: 1.544MHz, 2.048MHz,
4.096MHz, 8.192MHz, 12.288MHz, 16.384MHz, 256kHz, and 64kHz.
GTCCR3.CLKOSEL[3:0] selects the frequency.
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PDF描述
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DS26519GNA2 功能描述:網(wǎng)絡(luò)控制器與處理器 IC 16-Port E1/T1/J1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS26519GNA2+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC 16-Port E1/T1/J1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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