參數(shù)資料
型號: DS21FT40N
廠商: DALLAS SEMICONDUCTOR
元件分類: Digital Transmission Controller
英文描述: DATACOM, FRAMER, PBGA300
封裝: BGA-300
文件頁數(shù): 68/87頁
文件大小: 386K
代理商: DS21FT40N
DS21FT40
70 of 87
TRANSMIT SIDE TIMING Figure 16-7
12
34
5
6
7
8
9
10
1112
13
1415
16
FRAME#
1
TSYNC
12
345
6
14
15
16
2
Notes:
1. TSYNC in the frame mode (TCR1.1 = 0)
2. TSYNC in the multiframe mode (TCR1.1 = 1)
3. This diagram assumes both the CAS MF and the CRC4 begin with the align frame
TRANSMIT SIDE TIMING Figure 13.5
TRANSMIT SIDE BOUNDARY TIMING (with elastic store disabled)
Figure 16-8
LSB
MSB
CHANNEL 2
CHANNEL 1
2
3
TCLK
TSYNC
A
Sa4
Sa5
Sa6
Sa7
Sa8
Notes:
1. There is a 5 TCLK delay from TSER to TPOS and TNEG
2. TSYNC is in the input mode (TCR1.0 = 0)
3. TSYNC is in the output mode (TCR1.0 = 1)
4. Shown is a non-align frame boundary
TPOS, TNEG
Si
1
LSB
MSB
LSB
MSB
A
Sa4
Sa5
Sa6
Sa7
Sa8
TSER
Si
1
CHANNEL 1
MSB
CHANNEL 32
1
相關(guān)PDF資料
PDF描述
DS21FT40 DATACOM, FRAMER, PBGA300
DS21FT42 DATACOM, FRAMER, PBGA300
DS21FT42N DATACOM, FRAMER, PBGA300
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參數(shù)描述
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