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參數(shù)資料
| 型號： | DS2156LN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 78/265頁 |
| 文件大小： | 0K |
| 描述： | IC TXRX T1/E1/J1 1-CHIP 100-LQFP |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 功能： | 單芯片收發(fā)器 |
| 接口： | E1，J1，T1，TDM，UTOPIA II |
| 電路數(shù)： | 1 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 電流 - 電源： | 75mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
| 包括： | BERT 發(fā)生器和檢測器，CMI 編碼器和解碼器，HDLC 控制器 |
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DS2156
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24.2 UTOPIA Clock Modes
When the UTOPIA backplane is enabled, the user can select from several clocking modes: full T1/E1,
clear-channel E1, or fractional T1/E1. Because ATM bytes are byte-aligned in the frame, clear-channel
mode is only available in E1 operation. See Table 24-A for the various register configurations. Figure
24-1 shows a simplified diagram of the clock, data, and sync connections between the framer and the
UTOPIA block.
Figure 24-1. UTOPIA Clocking Configurations
24.3 Full T1/E1 Mode and Clear-Channel E1 Mode
In full T1/E1 mode, the framer is programmed to provide a constant clock (RCLK for the receiver and
TCLK for the transmitter) to the UTOPIA block by setting CCR3.4 and CCR3.5 = 1. The framer also
provides frame-sync pulses to the UTOPIA block. The UTOPIA block is programmed to use the clock
and sync signals by setting U_TCR2.1 and U_RCR2.1 = 0. In this mode the UTOPIA block uses the sync
signal to byte align the transmit data stream and locate the F-bit position in T1 operation and TS0 and
TS16 in E1 operation.
In T1 mode, the receive and transmit UTOPIA blocks always use the frame-sync pulse to gap out the F-
bit position.
In E1 mode, the transmit UTOPIA block can be programmed to gap out TS0 and TS16 by setting
U_TCR1.3 = 0, or use the full 256 bits of the frame by setting U_TCR1.3 = 1. Using the full 256 bits of
the frame is referred to as clear-channel mode and is only available in E1 mode. In full E1 mode, the
receive UTOPIA block always uses the frame-sync pulse to gap out TS0 and TS16. In order for the
receive UTOPIA block to operate in clear-channel mode, set U_RCR2.1 = 1 while in full clock mode or
use the fractional mode of operation described in Section 24.4 with all channels selected.
RECEIVE
FRAMER
RECEIVE
UTOPIA BLOCK
RCLK
GAPPED
CLOCK
FRAME SYNC
CLOCK
SYNC
TRANSMIT
FRAMER
TRANSMIT
UTOPIA BLOCK
TCLK
GAPPED
CLOCK
FRAME SYNC
CLOCK
SYNC
TCLK
DATA
CCR3.4
CCR3.5
0
1
NETWORK
UTOPIA
BACKPLANE
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參數(shù)描述 |
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| DS2156LN+ | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T1/E1/J1 Transceiver TDM/UTOPIA II Intrfc RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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