基于CPLD的三相多波形函數(shù)發(fā)生器設(shè)計(jì)
自適應(yīng)算術(shù)編碼的FPGA實(shí)現(xiàn)
基于高速串行BCD碼除法的數(shù)字頻率計(jì)的設(shè)計(jì)
數(shù)字頻率合成器的FPGA實(shí)現(xiàn)
用CPLD實(shí)現(xiàn)DSP與PLX9054之間的連接
一種新型的電子點(diǎn)菜系統(tǒng)
基于Rocket I/O模塊的高速工I/O設(shè)計(jì)
數(shù)字懸浮控制系統(tǒng)中的降噪方法及實(shí)現(xiàn)
低壓CPLD EPM7512A的混合電壓系統(tǒng)設(shè)計(jì)
使用PLD內(nèi)部鎖相環(huán)解決系統(tǒng)設(shè)計(jì)難題
用PROTEL DXP電路板設(shè)計(jì)的一般原則
NIOS軟核處理器的Linux引導(dǎo)程序U-boot設(shè)計(jì)
種新型快速線路板制作方法介紹
可編程邏輯器件APEX20K的原理及應(yīng)用
CPLD器件的在系統(tǒng)動(dòng)態(tài)配置
為時(shí)鐘源編程的計(jì)算機(jī)并行端口
數(shù)值計(jì)算中Bcd碼校驗(yàn)電路的分析與設(shè)計(jì)
一種可編程的全數(shù)字鎖相環(huán)路的實(shí)現(xiàn)
可復(fù)用SPI模塊IP核的設(shè)計(jì)與驗(yàn)證
采用FPGA實(shí)現(xiàn)脈動(dòng)陣列
一種基于FPGA實(shí)現(xiàn)的全數(shù)字鎖相環(huán)
基于新型FPGA實(shí)現(xiàn)高速數(shù)字下變頻
一種基于插值算法符號(hào)同步的硬件設(shè)計(jì)
基于FPGA的數(shù)字復(fù)接系統(tǒng)幀同步器設(shè)計(jì)與實(shí)現(xiàn)
基于FPGA和USB的高速數(shù)據(jù)傳輸、記錄及顯示系統(tǒng)
HDLC控制協(xié)議的FPGA設(shè)計(jì)與實(shí)現(xiàn)
DS-SS接收機(jī)全數(shù)字AGC的FPGA實(shí)現(xiàn)
基于FPGA的并行可變長(zhǎng)解碼器的實(shí)現(xiàn)
JTAG口及其對(duì)Flash的在線編程
用CPLD實(shí)現(xiàn)嵌入式平臺(tái)上的實(shí)時(shí)圖像增強(qiáng)
精確綜合：下一代FPGA綜合平臺(tái)
MC33289在汽車防抱死制動(dòng)系統(tǒng)中的應(yīng)用
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