參數資料
型號： CY7C1387DV25-225BZC
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： SRAM
英文描述： 1M X 18 CACHE SRAM, 2.8 ns, PBGA165
封裝： 13 X 15 MM, 1.40 MM HEIGHT, FBGA-165
文件頁數： 19/32頁
文件大?。?/td> 501K
代理商： CY7C1387DV25-225BZC
PRELIMINARY
CY7C1386DV25
CY7C1387DV25
Document #: 38-05548 Rev. **
Page 26 of 32
Read/Write Cycle Timing[22, 24, 25]
Note:
24. The data bus (Q) remains in high-Z following a Write cycle, unless a new read access is initiated by ADSP or ADSC.
25. GW is HIGH.
Switching Waveforms (continued)
tCYC
tCL
CLK
ADSP
tADH
tADS
ADDRESS
tCH
OE
ADSC
CE
tAH
tAS
A2
tCEH
tCES
Data Out (Q)
High-Z
ADV
Single WRITE
D(A3)
A4
A5
A6
D(A5)
D(A6)
Data In (D)
BURST READ
Back-to-Back READs
High-Z
Q(A2)
Q(A1)
Q(A4)
Q(A4+1)
Q(A4+2)
tWEH
tWES
Q(A4+3)
tOEHZ
tDH
tDS
tOELZ
tCLZ
tCO
Back-to-Back
WRITEs
A1
BWE, BWX
A3
DON’T CARE
UNDEFINED
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PDF描述
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