參數(shù)資料
型號： CLA70000DP48
英文描述： ASIC
中文描述： 專用集成電路
文件頁數(shù)： 13/17頁
文件大?。?/td> 243K
代理商： CLA70000DP48
Typical
Worst case propagation Delay (ns)
INTERMEDIATE BUFFER CELLS
Propagation
Commercial
Industrial
Name
Cells
Description
Symbol
Delay (ns)
Fanout
Fanout
Fanout =2
2
4
2
4
IBGATE
-
Large 2 Input NAND
Gate +2 Input NOR
tpLH
0.34
0.88
1.02
0.92
1.02
tpHL
0.27
0.71
0.84
0.75
0.88
IBDF
-
Master Slave D-type
tpLH
0.48
1.24
1.44
1.30
1.50
Flip-Flop
tpHL
0.50
1.31
1.42
1.37
1.49
IBCMOS1
CMOS input buffer
with 2 input NAND
gate
tpLH
0.60
1.58
1.68
1.65
1.75
tpLH
0.45
1.17
1.21
1.22
1.27
-
AC CHARACTERISTICS
Typical
Worst case propagation Delay (ns)
INTERNAL CORE CELLS
Propagation
Commercial
Industrial
Name
Cells
Description
Symbol
Delay (ns)
Fanout
Fanout
Fanout =2
2
4
2
4
INV2
1
Invertor Dual Drive
tpLH
0.27
0.70
0.84
0.73
0.88
tpHL
0.18
0.47
0.56
0.49
0.58
NAND2
1
2-Input NAND Gate
tpLH
0.39
1.01
1.29
1.05
1.35
tpHL
0.30
0.79
1.04
0.82
1.09
NOR2
1
2-Input NOR Gate
tpLH
0.50
1.30
1.81
1.35
1.89
tpHL
0.22
0.57
0.80
0.60
0.84
DF
1
Master Slave
tpLH
0.54
1.40
1.60
1.46
1.68
D-Type Flip-Flop
tpHL
0.55
1.44
1.55
1.51
1.62
Worst case propagation Delay (ns)
OUTPUT BUFFER CELLS
Name
Cells
Description
Symbol
OP3
-
Standard Output
Buffer
tpLH
0.73
1.90
6.49
1.99
6.79
tpHL
0.49
1.27
4.40
1.33
4.60
OP6
-
Medium Output
Buffer
tpHL
0.50
1.30
3.59
1.35
3.76
tpLH
0.33
0.85
2.42
0.89
2.53
OP12
-
Large Output
Buffer
tpLH
0.38
0.99
2.14
1.04
2.24
tpHL
0.25
0.66
1.50
0.69
1.56
Typical
Propagation
Commercial
Industrial
Delay (ns)
Fanout
Fanout
Fanout =10pF
10pF
50pF
10pF
50pF
Note
: Commercial worst case is 4.5V, 70
°
C operating
Industrial worst case is 4.5V, 85
°
C operating
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PDF描述
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