參數(shù)資料
型號(hào)： CH7008A-T
廠(chǎng)商： Electronic Theatre Controls, Inc.
英文描述： Digital PC to TV Encoder Features
中文描述： 數(shù)字電視編碼器電腦功能
文件頁(yè)數(shù)： 32/49頁(yè)
文件大?。?/td> 341K
代理商： CH7008A-T
CHRONTEL
CH7008A
32
201-0000-027 Rev 2.2, 9/30/99
Register Descriptions
(continued)
Input Data Format Register
Symbol: IDF
Address: 04H
Bits: 6
This register sets the variables required to define the incoming pixel data stream.
Reserved (bit 5): This bit should be set to 0.
DACG (bit 6): This bit controls the gain of the D/A converters. When DACG=0, the nominal DAC current is 71
μ
A, which provides the correct levels for NTSC and PAL-M. When DACG=1, the nominal DAC current is 76
μ
A,
which provides the correct levels for PAL and NTSC-J.
Clock Mode Register
Symbol: CM
Address: 06H
Bits: 8
The setting of the clock mode bits determines the clocking mechanism used in the CH7008. The clock modes are
shown in the table below. PCM controls the frequency of the P-OUT clock, and XCM identifies the frequency of the
XCLK input clock.
Bit:
Symbol:
Type:
Default:
7
6
DACG
5
Reserved
4
3
IDF3
2
IDF2
1
IDF1
0
IDF0
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
Table 17. Input Data Format
IDF[3:0]
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001-1111
Description
Not available
Not available
Not available
Not available
12-bit multiplexed RGB (24-bit color) input (“C” multiplex scheme)
12-bit multiplexed RGB (24-bit color) input (“I” multiplex scheme)
Not available
8-bit multiplexed RGB (16-bit color, 565) input
8-bit multiplexed RGB (15-bit color, 555) input
8-bit multiplexed YCrCb (24-bit color) input (Y, Cr and Cb are multiplexed)
Bit:
Symbol:
Type:
Default:
7
CFRB
6
M/S*
5
Reserved
4
MCP
3
XCM1
2
XCM0
1
PCM1
0
PCM0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
1
0
0
0
0
相關(guān)PDF資料
PDF描述
CH7008A-V Digital PC to TV Encoder Features
CH7012 Chrontel CH7012 TV Output Device
CH7012A Chrontel CH7012 TV Output Device
CH7012A-T Chrontel CH7012 TV Output Device
CH7202 MPEG to TV Encoder with 8-bit Input
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參數(shù)描述
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