- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄17155 > C8051T606DK (Silicon Laboratories Inc)KIT DEVELOPMENT FOR C8051T606 PDF資料下載
參數(shù)資料
| 型號： | C8051T606DK |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 77/188頁 |
| 文件大?。?/td> | 0K |
| 描述： | KIT DEVELOPMENT FOR C8051T606 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | C8051T606 |
| 所含物品： | 板，適配器，線纜，CD，電源 |
| 產(chǎn)品目錄頁面： | 626 (CN2011-ZH PDF) |
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| 其它名稱： | 336-1666 |
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C8051T600/1/2/3/4/5/6
168
Rev. 1.2
26.3.5. 8-bit Pulse Width Modulator Mode
The duty cycle of the PWM output signal in 8-bit PWM mode is varied using the module's PCA0CPLn Cap-
ture/Compare register. When the value in the low byte of the PCA counter/timer (PCA0L) is equal to the
value in PCA0CPLn, the output on the CEXn pin will be set. When the count value in PCA0L overflows, the
CEXn output will be reset (see Figure 26.8). Also, when the counter/timer low byte (PCA0L) overflows from
0xFF to 0x00, PCA0CPLn is reloaded automatically with the value stored in the module’s Capture/Com-
pare high byte (PCA0CPHn) without software intervention. Setting the ECOMn and PWMn bits in the
PCA0CPMn register enables 8-Bit Pulse Width Modulator mode. If the MATn bit is set to 1, the CCFn flag
for the module will be set each time an 8-bit comparator match (rising edge) occurs. The duty cycle for 8-
Bit PWM Mode is given in Equation 26.2.
Important Note about Capture/Compare Registers: When writing a 16-bit value to the PCA0 Cap-
ture/Compare registers, the low byte should always be written first. Writing to PCA0CPLn clears the
ECOMn bit to 0; writing to PCA0CPHn sets ECOMn to 1.
Equation 26.2. 8-Bit PWM Duty Cycle
Using Equation 26.2, the largest duty cycle is 100% (PCA0CPHn = 0), and the smallest duty cycle is
0.39% (PCA0CPHn = 0xFF). A 0% duty cycle may be generated by clearing the ECOMn bit to 0.
Figure 26.8. PCA 8-Bit PWM Mode Diagram
Duty Cycle
256
PCA0CPHn
–
256
---------------------------------------------------
=
8-bit
Comparator
PCA0L
PCA0CPLn
PCA0CPHn
CEXn
Crossbar
Port I/O
Enable
Overflow
PCA Timebase
00 x 0
x
Q
SET
CLR
S
R
match
PCA0CPMn
P
W
M
1
6
n
E
C
O
M
n
E
C
F
n
T
O
G
n
P
W
M
n
C
A
P
n
C
A
P
N
n
M
A
T
n
0
ENB
0
1
Write to
PCA0CPLn
Write to
PCA0CPHn
Reset
COVF
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