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參數(shù)資料
| 型號： | C8051T600DK |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 144/188頁 |
| 文件大?。?/td> | 0K |
| 描述： | KIT DEV FOR C8051T60X MCU'S |
| 標準包裝： | 1 |
| 類型： | MCU |
| 適用于相關產(chǎn)品： | C8051T600，C8051T601，C8051T602，C8051T603，C8051T604，C8051T605 |
| 所含物品： | 評估板，電源，USB 線纜，適配器和文檔 |
| 產(chǎn)品目錄頁面： | 626 (CN2011-ZH PDF) |
| 相關產(chǎn)品： | 336-1663-6-ND - IC 8051 MCU 1.5K-EEPROM 10-QFN 336-1663-2-ND - IC 8051 MCU 1.5K-EEPROM 10-QFN 336-1664-5-ND - IC 8051 MCU 1.5K-EEPROM 10-MSOP 336-1663-1-ND - IC 8051 MCU 1.5K-EEPROM 10-QFN 336-1662-5-ND - IC 8051 MCU 1.5K-EEPROM 11-QFN 336-1661-5-ND - IC 8051 MCU 2K-EEPROM 14-SOIC 336-1660-5-ND - IC 8051 MCU 2K-EEPROM 11-QFN 336-1659-5-ND - IC 8051 MCU 2K-EEPROM 14-SOIC 336-1658-5-ND - IC 8051 MCU 2K-EEPROM 11-QFN 336-1657-5-ND - IC 8051 MCU 4K-EEPROM 14-SOIC 更多... |
| 其它名稱： | 336-1404 |
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Rev. 1.2
59
C8051T600/1/2/3/4/5/6
13. Comparator0
C8051T600/1/2/3/4/5/6 devices include an on-chip programmable voltage comparator, Comparator0,
shown in Figure 13.1.
The Comparator offers programmable response time and hysteresis, an analog input multiplexer, and two
outputs that are optionally available at the Port pins: a synchronous “l(fā)atched” output (CP0), or an asyn-
chronous “raw” output (CP0A). The asynchronous CP0A signal is available even when the system clock is
not active. This allows the Comparator to operate and generate an output with the device in STOP mode.
When assigned to a Port pin, the Comparator output may be configured as open drain or push-pull (see
Section “22.4. Port I/O Initialization” on page 114). Comparator0 may also be used as a reset source (see
The Comparator0 inputs are selected by the comparator input multiplexer, as detailed in Section
Figure 13.1. Comparator0 Functional Block Diagram
The Comparator output can be polled in software, used as an interrupt source, and/or routed to a Port pin.
When routed to a Port pin, the Comparator output is available asynchronous or synchronous to the system
clock; the asynchronous output is available even in STOP mode (with no system clock active). When dis-
abled, the Comparator output (if assigned to a Port I/O pin via the Crossbar) defaults to the logic low state,
and the power supply to the comparator is turned off. See Section “22.3. Priority Crossbar Decoder” on
page 111 for details on configuring Comparator outputs via the digital Crossbar. Comparator inputs can be
VDD
CPT0CN
Reset
Decision
Tree
+
-
Crossbar
Interrupt
Logic
Q
SET
CLR
D
Q
SET
CLR
D
(SYNCHRONIZER)
GND
CP0 +
CP0 -
CP0EN
CP0OUT
CP0RIF
CP0FIF
CP0HYP1
CP0HYP0
CP0HYN1
CP0HYN0
CP
T0MD
CP0MD1
CP0MD0
CP0
Rising-edge
Interrupt Flag
CP0
Falling-edge
Interrupt Flag
CP0
CP0A
Comparator
Input Mux
相關PDF資料 |
PDF描述 |
|---|---|
| HPL0603-2N2 | INDUCTOR 2.2NH +/-0.2NH 0201 |
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| 22R104MC | IND 100UH 0.8A DRUM 7.8X7.5 SMD |
| GEM36DRKI | CONN EDGECARD 72POS DIP .156 SLD |
| C8051F336DK | DEV KIT FOR C8051F336 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| C8051T600EDB | 功能描述:子卡和OEM板 Flash Emulation Daughter Board RoHS:否 制造商:BeagleBoard by CircuitCo 產(chǎn)品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit |
| C8051T600-EDB | 制造商:Silicon Laboratories Inc 功能描述:C8051T600 Evaluation Daughter Board 制造商:Silicon Laboratories Inc 功能描述:FLASH EMULATION DAUGHTER BOARD - Boxed Product (Development Kits) |
| C8051T600-EDB-K | 功能描述:FLASH EMULATION DAUGHTER BOARD 制造商:silicon labs 系列:* 零件狀態(tài):在售 標準包裝:1 |
| C8051T600-GM | 功能描述:8位微控制器 -MCU 8K OTP 25 MIPS 10bit 500ksps ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051T600-GMR | 功能描述:8位微控制器 -MCU 8K OTP 25 MIPS 10bit 500ksps ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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